參數(shù)資料
型號： MPC566MZP56
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁數(shù)： 869/1387頁
文件大小： 18462K
代理商： MPC566MZP56
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MOTOROLA
Chapter 13. Queued Analog-To-Digital Converter (QADC64E)
13-25
Programming the QADC64E Registers
One or both queues may be in the idle state. When a queue is idle, CCWs are not being
executed for that queue, the queue is not in the pause state, and there is not a trigger
pending.
The idle state occurs when a queue is disabled, when a queue is in a reserved mode, or when
a queue is in a valid queue operating mode awaiting a trigger event to initiate queue
execution.
A queue is in the active state when a valid queue operating mode is selected, when the
selected trigger event has occurred, or when the QADC64E is performing a conversion
specified by a CCW from that queue.
Only one queue can be active at a time. Either or both queues can be in the paused state. A
queue is paused when the previous CCW executed from that queue had the pause bit set.
The QADC64E does not execute any CCWs from the paused queue until a trigger event
occurs. Consequently, the QADC64E can service queue 2 while queue 1 is paused.
Only queue 2 can be in the suspended state. When a trigger event occurs on queue 1 while
queue 2 is executing, the current queue 2 conversion is aborted. The queue 2 status is
reported as suspended. Queue 2 transitions back to the active state when queue 1 becomes
idle or paused.
A trigger pending state is required since both queues cannot be active at the same time. The
status of queue 2 is changed to trigger pending when a trigger event occurs for queue 2
while queue 1 is active. In the opposite case, when a trigger event occurs for queue 1 while
queue 2 is active, queue 2 is aborted and the status is reported as queue 1 active, queue 2
suspended. So due to the priority scheme, only queue 2 can be in the trigger pending state.
There are two transition cases which cause the queue 2 status to be trigger pending before
queue 2 is shown to be in the active state. When queue 1 is active and there is a trigger
pending on queue 2, after queue 1 completes or pauses, queue 2 continues to be in the
trigger pending state for a few clock cycles. The following are fleeting status conditions:
Queue 1 idle with queue 2 trigger pending
Queue 1 paused with queue 2 trigger pending
1010
queue 1 active, queue 2 suspended
1011
queue 1 active, queue 2 trigger pending
1100
Reserved
1101
Reserved
1110
Reserved
1111
Reserved
Table 13-15. Queue Status (continued)
QS[9:6]
Queue 1/Queue 2 States
相關(guān)PDF資料
PDF描述
MPC566CZP40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC565CVR40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC565MZP56R2 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC565CVR56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
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參數(shù)描述
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