參數(shù)資料
型號： MPC566MZP56
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁數(shù)： 819/1387頁
文件大?。?/td> 18462K
代理商： MPC566MZP56
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MOTOROLA
Chapter 11. L-Bus to U-Bus Interface (L2U)
11-9
Reservation Support
The reservation logic in the L2U performs the following functions:
Snoops accesses to all L-bus and U-bus slaves
Holds one reservation (address) for the core
Sets the reservation flag when the CPU issues a load-with-reservation request
The unit for reservation is one word. A byte or half-word store request by another master
will clear the reservation flag.
A load-with-reservation request by the CPU updates the reservation address related to a
previous load-with-reservation request and sets the reservation flag for the new location. A
store-with-reservation request by the CPU clears the reservation flag. A store request by the
CPU does not clear the flag. A store request by some other master to the reservation address
clears the reservation flag.
If the storage reservation is lost, it is guaranteed that a store-with-reservation request by the
CPU will not modify the storage.
The L2U does not start a store-with-reservation cycle on the U-bus if the reserved location
on the U-bus has been touched by another master. The L2U drives the reservation status
back to the core.
When the reserved location in the SRAM on the L-bus is touched by an alternate master,
on the following clock, the L2U indicates to the CPU that the reservation has been touched.
On assertion of the cancel-reservation signal, the RCPU clears the internal reservation bit.
If an stwcx cycle has been issued at the same time, the RCPU aborts the cycle. Software
must check the CR0[EQ] bit to determine if the stwcx instruction completed successfully.
Storage reservation is set regardless of the termination status (address or data phase) of the
lwarx access. Storage reservation is cleared regardless of the data phase termination status
of the stwcx access if the address phase is terminated normally.
Storage reservation will be cleared regardless of the data phase termination status of the
write requests by another master to the reserved address if the address phase of the write
access is terminated normally on the destination (U-bus/L-bus) bus.
If the programmable memory map of the part is modified between a lwarx and a stwcx
instruction, the reservation is not guaranteed.
11.6.3 Reserved Location (Bus) and Possible Actions
Once the CPU core reserves a memory location, the L2U module is responsible for
snooping L-bus and U-bus for possible intrusion of the reserved location. Under certain
circumstances, the L2U depends on the USIU or the UIMB to provide status of reservation
on external bus and the IMB3 respectively.
Table 11-2 lists all reservation protocol cases supported by the L2U snooping logic.
相關PDF資料
PDF描述
MPC566CZP40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC565CVR40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC565MZP56R2 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC565CVR56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC60333 32-BIT, 33.33 MHz, RISC PROCESSOR, CQFP240
相關代理商/技術參數(shù)
參數(shù)描述
MPC566MZP56 制造商:Freescale Semiconductor 功能描述:32-BIT MICROCONTROLLER IC POWER 5xx 56
MPC5673F 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5674F Microcontroller Data Sheet
MPC5673K 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontroller is a 32-bit embedded controller designed for advanced
MPC5674ADAT516 制造商:Freescale Semiconductor 功能描述:ADAPTER BOARD FOR MPC567 - Boxed Product (Development Kits)
MPC5674F 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5674F Microcontroller Data Sheet
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