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參數(shù)資料
| 型號： | MPC8377EWLANB |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 41/127頁 |
| 文件大?。?/td> | 0K |
| 描述： | ACCESS POINT/ROUTER MPC8377 |
| 標(biāo)準(zhǔn)包裝： | 1 |
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MPC8377E PowerQUICC II Pro Processor Hardware Specifications, Rev. 8
20
Freescale Semiconductor
6.2.2
DDR1 and DDR2 SDRAM Output AC Timing Specifications
This table shows the DDR1 and DDR2 SDRAM output AC timing specifications.
Table 21. DDR1 and DDR2 SDRAM Output AC Timing Specifications
Parameter
Symbol1
Min
Max
Unit
Note
MCK
n cycle time, MCKn/MCKn crossing
tMCK
510
ns
ADDR/CMD output setup with respect to MCK
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHAS
1.95
2.40
3.15
4.20
—
ns
ADDR/CMD output hold with respect to MCK
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHAX
1.95
2.40
3.15
4.20
—
ns
MCS
n output setup with respect to MCK
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHCS
1.95
2.40
3.15
4.20
—
ns
MCS
n output hold with respect to MCK
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHCX
1.95
2.40
3.15
4.20
—
ns
MCK to MDQS skew
tDDKHMH
–0.6
0.6
ns
MDQ//MDM output setup with respect to MDQS
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHDS,
tDDKLDS
550
800
1100
1200
—
ps
MDQ//MDM output hold with respect to MDQS
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHDX,
tDDKLDX
700
800
1100
1200
—
ps
MDQS preamble start
tDDKHMP
–0.5
× tMCK –0.6
–0.5
× tMCK + 0.6
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 0622022010 | TOOL INSERTION 40POS 4ROWS |
| MPC8377EWLANA | ACCESS POINT/ROUTER MPC8377 |
| 76250ENC | XFRMR MAX250 EN60950 APPROVED |
| DR-TRC105-434-EV | BOARD EVALUATION 434MHZ RFM RFIC |
| DR-TRC105-403-EV | BOARD EVALUATION 403MHZ RFM RFIC |
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