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參數(shù)資料
| 型號： | PEB2445N |
| 廠商： | SIEMENS AG |
| 英文描述： | LTM4600 Evaluation Kit |
| 中文描述： | ？多點交換和會議股-衰減？ |
| 文件頁數(shù)： | 35/70頁 |
| 文件大?。?/td> | 1236K |
| 代理商： | PEB2445N |
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PEB 2445
Functional Description
Semiconductor Group
35
02.96
2.2
The MUSAC-A is programmed via the
μ
P interface. It consists of the address data bus
AD7
…
AD0, the address bits A1
…
A0, the Write (WR), the Read (RD), the Address
Latch Enable (ALE), the Interrupt (INT) and the Chip Select (CS) signal, as shown in
figure 16
.
Microprocessor Interface and Registers
Figure 16
The MUSAC
TM
-A Controlled by a Microprocessor
The standard 8-bit
μ
P interface can communicate with Intel multiplexed/demultiplexed
microprocessors. It gives access to the internal registers and to the control memories
(Connection Memory, Conference Control Memory).
Table 4
μ
P-Interface Functions
ALE is internally set to ground if it is not connected.
For a demultiplexed
μ
P interface the address bits A1 and A0 are needed for addressing
a register. For the
μ
P-interface timing please refer to
chapter 5.3
.
ALE
Type of
μ
P Interface
Intel
Intel
Bus Structure
Pin 24
Pin 25
Fixed to ground
Switching
demultiplexed
multiplexed
RD
RD
WR
WR
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