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參數(shù)資料
| 型號： | PEB2445N |
| 廠商： | SIEMENS AG |
| 英文描述： | LTM4600 Evaluation Kit |
| 中文描述： | ？多點交換和會議股-衰減？ |
| 文件頁數(shù)： | 43/70頁 |
| 文件大?。?/td> | 1236K |
| 代理商： | PEB2445N |
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PEB 2445
Detailed Register Description
Semiconductor Group
43
02.96
Input Pin Arrangement
Table 8
Input and Output Pin Arrangement for the Standard Configuration
Note: The input line numbers shown are the logical line numbers to be used for
programming the connection memory and the conference control memory. In the
case of 16 input lines the logical line numbers are identical to the pin names.
Output Pin Arrangement
Note: The logical output line numbers shown above are identical to the pin names.
Pin No.
16
×
8 Mbit/s
16
×
2 Mbit/s
IN1
IN0
IN5
IN4
IN9
IN8
IN13
IN12
IN14
IN15
IN10
IN11
IN6
IN7
IN2
IN3
4
×
8
Mbit/s
8
×
2 + 2
×
8
Mbit/s
8
×
4
Mbit/s
8
×
2 + 4
×
4
Mbit/s
4
5
7
8
9
10
11
12
13
14
15
16
17
18
19
20
IN1
IN0
IN2
IN3
IN0
IN4
IN8
IN1
IN12
IN14
IN3
IN10
IN6
IN2
IN1
IN0
IN5
IN4
IN6
IN7
IN2
IN3
IN0
IN4
IN1
IN8
IN5
IN12
IN14
IN7
IN10
IN3
IN6
IN2
Pin No.
8
×
2
Mbit/s
OUT7
OUT6
OUT5
OUT4
OUT3
OUT2
OUT1
OUT0
2
×
8
Mbit/s
4
×
2 + 1
×
8
Mbit/s
OUT7
4
×
4
Mbit/s
4
×
2 + 2
×
4
Mbit/s
OUT7
35
36
37
38
40
41
42
43
OUT1
OUT0
OUT5
OUT3
OUT1
OUT0
OUT3
OUT2
OUT1
OUT0
OUT5
OUT3
OUT2
OUT1
OUT0
相關PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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