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參數(shù)資料
| 型號(hào)： | PEF2015 |
| 廠商： | SIEMENS A G |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Mini IOM-2 Controller MICO |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, PDSO28 |
| 文件頁(yè)數(shù)： | 33/84頁(yè) |
| 文件大?。?/td> | 1568K |
| 代理商： | PEF2015 |
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PEF 2015
Registers Summary
Semiconductor Group
33
12.97
4
Registers Summary
4.1
Register Address Arrangement
Group
Reg Name
Access
Address
mux
AD7..0
Address
demux
OMDR:RBS/
A3..0
Reset
Value
Comment
refer to
page
1.
MICO
PCM
PMOD
RD/WR
20
H
22
H
24
H
1/0
H
1/1
H
1/2
H
00
H
FF
H
00
H
PCM-mode reg.
35
PBNR
RD/WR
PCM-bit number reg.
36
POFD
RD/WR
PCM-offset
downstream reg.
36
POFU
RD/WR
26
H
1/3
H
00
H
PCM-offset upstream
reg.
37
PCSR
RD/WR
28
H
2A
H
2C
H
2E
H
30
H
32
H
1/4
H
1/5
H
1/6
H
1/7
H
1/8
H
1/9
H
00
H
xx
H
00
H
00
H
FF
H
00
H
PCM-clock shift reg.
38
PICM
RD
dummy
38
2.
MICO
CFI
CMD1
RD/WR
CFI-mode reg. 1
39
CMD2
RD/WR
CFI-mode reg. 2
41
CBNR
RD/WR
CFI-bit number reg.
44
CTAR
RD/WR
CFI time slot
adjustment reg.
44
CBSR
RD/WR
34
H
36
H
00
H
1/A
H
1/B
H
0/0
H
00
H
00
H
xx
H
CFI-bit shift reg.
45
CSCR
RD/WR
CFI-subchannel reg.
47
3.
MICO
memory
access
MACR
RD/WR
memory access
control reg.
48
MAAR
RD/WR
02
H
0/1
H
xx
H
memory access
address reg.
52
MADR
RD/WR
04
H
0/2
H
xx
H
memory access data
reg.
53
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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