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參數(shù)資料
| 型號： | PM7383 |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| 中文描述： | 框架引擎和數(shù)據(jù)鏈路管理32A256 |
| 文件頁數(shù)： | 86/231頁 |
| 文件大?。?/td> | 1947K |
| 代理商： | PM7383 |
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RELEASED
DATASHEET
PM7383 FREEDM-32A256
ISSUE 1
PMC-2010336
FRAME ENGINE AND DATA LINK MANAGER 32A256
PROPRIETARY AND CONFIDENTIAL
78
cleared to begin accumulating events for a new accumulation interval. The bits in
this register are not affected by write accesses.
SYSCLKA:
The system clock active bit (SYSCLKA) monitors for low to high transitions on
the SYSCLK input. SYSCLKA is set high on a rising edge of SYSCLK, and is
set low when this register is read.
TBDA:
The transmit BERT data active bit (TBDA) monitors for low to high transitions
on the TBD input. TBDA is set high on a rising edge of TDB, and is set low
when this register is read.
RFP8A:
The receive 8.192 Mbps H-MVIP frame pulse activity bit (RFP8A) monitors for
low to high transitions on the RFP8B input. RFP8A is set high when RFP8B
has been sampled low and sampled high by falling edges of the RMV8FPC,
and is set low when this register is read.
TFP8A:
The transmit 8.192 Mbps H-MVIP frame pulse activity bit (TFP8A) monitors
for low to high transitions on the TFP8B input. TFP8A is set high when
TFP8B has been sampled low and sampled high by falling edges of the
TMV8FPC, and is set low when this register is read.
RFPA[3:0]:
The receive frame pulse activity bits (RFPA[3:0]) monitor for low to high
transitions on the RFPB[3:0] inputs. RFPA[n] is set high when RFPB[n] has
been sampled low and sampled high by falling edges of the corresponding
RMVCK[n], and is set low when this register is read.
TFPA[3:0]:
The transmit frame pulse activity bits (TFPA[3:0]) monitor for low to high
transitions on the TFPB[3:0] inputs. TFPA[n] is set high when TFPB[n] has
been sampled low and sampled high by falling edges of the corresponding
TMVCK[n], and is set low when this register is read.
RXCLKA / TXCLKA:
The Any-PHY clock active bits (RXCLKA, TXCLKA) monitor for low to high
transitions on the RXCLK and TXCLK inputs respectively. RXCLKA and
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7383-PI | FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7384 | Frame Engine and Data Link Manager |
| PM7384-BI | FRAME ENGINE AND DATA LINK MANAGER 84P672 |
| PM7385 | Frame Engine and Data Link Manager |
| PM7385-BI | 84 LINK, 672 CHANNEL FRAME ENGINE AND DATA LINK MANAGER WITH ANY-PHY PACKET INTERFACE |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM7383-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7384 | 制造商:PMC 制造商全稱:PMC 功能描述:Frame Engine and Data Link Manager |
| PM7384-BI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER 84P672 |
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