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參數(shù)資料
| 型號： | RH80532GC029512 |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 45/93頁 |
| 文件大?。?/td> | 2353K |
| 代理商： | RH80532GC029512 |
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Mobile Intel
Pentium
4 Processor-M
250686-002
Datasheet
45
Figure 18. Test Reset Timings
Figure 16. Power Up Sequence
Figure 17. Power Down Sequence
BCLK
Vcc
PWRGOOD
RESET#
VCCVID
VID_GOOD
VID[4:0],
BSEL[1:0]
Tc
Td
Ta= 1us minimum (VCCVID > 1V to VID_GOOD high)
Tb= 50ms maximum (VID_GOOD to Vcc valid maximum time)
Tc= T37 (PWRGOOD inactive pulse width)
Td= T36 (PWRGOOD to RESET# de-assertion time)
Note: VID_GOOD is not a processor signal. This signal is routed to the
output enable pin of the voltage regluator control silicon. For more
information on implementation refer to the Intel Mobile Northwood
Processor and Intel 845MP Platform RDDP.
Ta
Tb
Note: VID_GOOD is not a processor signal. This signal is routed to the
output enable pin of the voltage regluator control silicon. For more
information on implementation refer to the Intel Mobile Northwood
Processor and Intel 845MP Platform RDDP.
1. This timing diagram is not intended to show specific times. Instead a
general ordering of events with respect to time should be observed.
2. When VCCVID is less than 1V, VID_GOOD must be low.
3. Vcc must be disabled before VID[4:0] becomes invalid.
4. VCCVID and Vcc regulator can be disabled simultaneously
Vcc
PWRGOOD
VCCVID
VID_GOOD
VID[4:0]
相關PDF資料 |
PDF描述 |
|---|---|
| RH80532GC033512 | Microprocessor |
| RH80532NC017256 | Microprocessor |
| RH80532NC021256 | Microprocessor |
| RH80532NC025256 | Microprocessor |
| RH80532NC029256 | Microprocessor |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| RH80532GC029512S L6V6 | 制造商:Intel 功能描述:MPU Pentium? 4 Processor-M 0.13um 1.7GHz 478-Pin uFCPGA |
| RH80532GC029512SL6V6 | 制造商:Intel 功能描述:MPU Pentium 4 Processor-M 0.13um 1.7GHz 478-Pin uFCPGA |
| RH80532GC033512 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| RH80532GC049512 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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