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參數(shù)資料
| 型號： | S1C7XXXF00E199 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 90 MHz, RISC MICROCONTROLLER, PQFP |
| 文件頁數(shù)： | 169/196頁 |
| 文件大小： | 1650K |
| 代理商： | S1C7XXXF00E199 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁當(dāng)前第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁
7 DETAILS OF INSTRUCTIONS
7-10
EPSON
S1C17 FAMILY S1C17 CORE MANUAL
and
%rd, %rs
and/c
%rd, %rs
and/nc %rd, %rs
Function
16-bit logical AND
Standard)
rd
(15:0)
← rd(15:0) & rs(15:0), rd(23:16) ← 0
Extension 1) rd(15:0)
← rs(15:0) & imm13(zero extended), rd(23:16) ← 0
Extension 2) rd(15:0)
← rs(15:0) & imm16, rd(23:16) ← 0
Code
15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
0 0 1 0 1 1
r d
1 0 0 0
r s
and
|
0 0 1 0 1 1
r d
0 0 0 0
r s
and/c
|
0 0 1 0 1 1
r d
0 1 0 0
r s
and/nc
|
Flag
IL IE
C
V
Z
N
– – – 0
|
Mode
Src:Register direct %rs = %r0 to %r7
Dst:Register direct %rd = %r0 to %r7
CLK
One cycle
Description (1) Standard
and
%rd,%rs
; rd
← rd & rs
The content of the rs register and that of the rd register are logically AND’ed, and the result is
loaded into the rd register. The operation is performed in 16-bit size, and bits 23–16 of the rd
register are set to 0.
(2) Extension 1
ext
imm13
and
%rd,%rs
; rd
← rs & imm13
The content of the rs register and the zero-extended 13-bit immediate imm13 are logically
AND’ed, and the result is loaded into the rd register. The operation is performed in 16-bit size,
and bits 23–16 of the rd register are set to 0. The content of the rs register is not altered.
(3) Extension 2
ext
imm13
; imm13(2:0) = imm16(15:13)
ext
imm13
; = imm16(12:0)
and
%rd,%rs
; rd
← rs & imm16
The content of the rs register and the 16-bit immediate imm16 are logically AND’ed, and the
result is loaded into the rd register. The operation is performed in 16-bit size, and bits 23–16 of
the rd register are set to 0. The content of the rs register is not altered.
(4) Conditional execution
The /c or /nc suffix on the opcode specifies conditional execution.
and/c
Executed as and when the C flag is 1 or executed as nop when the flag is 0
and/nc Executed as and when the C flag is 0 or executed as nop when the flag is 1
In this case, the ext instruction can be used to extend the operand.
(5) Delayed slot instruction
This instruction may be executed as a delayed slot instruction by writing it directly after
a branch instruction with the “d” bit. In this case, extension of the immediate by the ext
instruction cannot be performed.
Example
(1) and
%r0,%r0
; r0 = r0 & r0
(2) ext
0x1
ext
0x1fff
and
%r1,%r2
; r1 = r2 & 0x3fff
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