參數(shù)資料
型號: UPD75518
廠商: NEC Corp.
英文描述: 4 BIT SINGLE-CHIP MICROCOMPUTER
中文描述: 4位單片機(jī)
文件頁數(shù): 59/180頁
文件大?。?/td> 1595K
代理商: UPD75518
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59
μ
PD75518(A)
(7) Procedure for changing the system clock and CPU clock
The procedure for changing the system clock and CPU clock is explained using Fig. 4-16.
Fig. 4-16 Changing the System Clock and CPU Clock
1
The generation of a RESET signal starts CPU operation at the lowest speed of the main system
clock
Note 1
after a wait time
Note 2
for stable oscillation.
The PCC is rewritten for highest-speed operation after a time elapse which is sufficient for the voltage
on the V
DD
pin to be high enough for highest-speed operation.
The removal of commercial power is detected using, for example, an interrupt input (INT4 is useful),
then SCC.0 is set to operate with the subsystem clock. (In this case, the start of subsystem clock
generation must be confirmed beforehand.) After a time (32 machine cycles) required to switch to
the subsystem clock elapses, SCC.3 is set to terminate main system clock generation.
After detecting the input of commercial power by using an interrupt, SCC.3 is cleared to start main
system clock generation. After a time required for stable generation, SCC.0 is cleared to operate at
highest speed.
2
3
4
Notes 1.
10.7
μ
s (at 6.0 MHz) or 15.3
μ
s (at 4.19 MHz)
2.
21.8 ms (at 6.0 MHz) or 31.3 ms (at 4.19 MHz)
ON
OFF
Commercial
power
line voltage
V
DD
pin voltage
RESET signal
System clock
CPU clock
Wait (31.3 ms)
f
X
= 4.19 MHz
f
XT
= 32.768 kHz
X
15.3 s
X
0.95 s
XT
122 s
X
0.95 s
Internal reset
operation
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