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參數(shù)資料
| 型號： | UPD75518 |
| 廠商： | NEC Corp. |
| 英文描述： | 4 BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機 |
| 文件頁數(shù)： | 88/180頁 |
| 文件大?。?/td> | 1595K |
| 代理商： | UPD75518 |
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88
μ
PD75518(A)
Fig. 4-35 Format of Serial Operation Mode Register 0 (CSIM0) (3/3)
Note
COI can be read only before serial transfer is started or after serial transfer is completed. An
undefined value may be read during transfer.
COI data written by an 8-bit manipulation instruction is ignored.
Serial interface operation enable/disable specification bit (W)
Remarks 1.
Each mode can be selected by setting CSIE0, CSIM03, and CSIM02.
2.
The P01/SCK0 pin assumes the following state according to the setting of CSIE0, CSIM01, and
CSIM00:
Condition for being set (COI = 1)
When the slave address register (SVA) matches the
data of the shift register
COI
Note
Condition for being cleared (COI = 0)
When the slave address register (SVA) does not match
the data of the shift register
0
1
Serial clock counter
Cleared
Count operation
IRQCSI0 flag
Held
Can be set.
SO0/SB0, SI0/SB1 pin
Used only for port 0
Used in each mode as
well as for port 0
CSIE0
Shift register operation
Shift operation disabled
Shift operation enabled
CSIE0
0
1
1
1
CSIM03
×
0
1
1
CSIM02
×
×
0
1
Operation mode
Operation halt mode
Three-wire serial I/O mode
SBI mode
Two-wire serial I/O mode
CSIE0
0
1
0
0
0
1
1
1
CSIM01
0
0
1
0
1
1
0
1
CSIM00
0
0
0
1
1
0
1
1
P01/SCK0 pin state
Input port
High impedance
High level output
Serial clock output (High level output)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD75518GF | CAT5E PATCH CABLES SNAGLESS, RED 3 FT |
| UPD75518GFA | 4 BIT SINGLE-CHIP MICROCOMPUTER |
| UPD75518A | 4 BIT SINGLE-CHIP MICROCOMPUTER |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| UPD7554AG-597-E2-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD7554AG-603-E2 | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD7554AG-603-E2-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD7554AG-611-E2 | 制造商:Renesas Electronics Corporation 功能描述: |
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