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參數(shù)資料
| 型號(hào)： | W89C880F |
| 英文描述： | LAN Hub Controller |
| 中文描述： | 局域網(wǎng)集線器控制器 |
| 文件頁(yè)數(shù)： | 68/72頁(yè) |
| 文件大小： | 731K |
| 代理商： | W89C880F |
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W89C840F
- 68 -
AC Characteristics (VDD=4.75 V to 5.25V, VSS=0 V,TA = 0
°
C to 70
°
C)
32KX8-220 BPROM/ FLASH MEMORY
Read cycle
1
CLK
FRAME#
AD[31::0]
TRDY#
IRDY#
C_BEB[3:0]#
DEVSEL#
MSA14/L
MSA[9:0]
MSA[13:10]
BPCSB
MSRDB
MSD[7:0]
0
2
3
4
5
6
7
8
9
10
11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26
T1
T2
T3
T4
T5
T6
T7
T8
T9
T10
T11
T12
T9
T10
T11
T12
SYMBOL
DESCRIPTION
Min.
typical
MAX
UNIT
T1
clock 4 to MSA14/L valid
8
13
18
nsec
T2
clock 5 to MSA14/L deasserted time
8
13
18
nsec
T3
clock 6 to MSA bus valid
8
13
18
nsec
T4
clock 14 to MSA bus valid
8
13
18
nsec
T5
clock 23 to MSA deasserted
8
13
18
nsec
T6
clock 4 to MSA high nibble valid
8
13
18
nsec
T7
clock 6 to BPCSB valid
15
20
25
nsec
T8
clock 25 to BPCSB deasserted
7
12
17
nsec
T9
clock 8/ clock 17 to MSRDB asserted time
15
20
25
nsec
T10
clock 13/ clock 22 to MSRDB deasserted time
8
13
18
nsec
T11
MSD setup time from clock 13
7
nsec
T12
MSD hold time from clock 15
0
nsec
Note: 1) The other timing requirements for PCI signal are as the read transaction timing.
2) BPROM/FLASH memory access could be byte, word or double word access. The timing is the
same.
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PDF描述 |
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