- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄19303 > XC3S1000-4FTG256I (Xilinx Inc)SPARTAN-3A FPGA 1M STD 256-FTBGA PDF資料下載
參數(shù)資料
| 型號(hào)： | XC3S1000-4FTG256I |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 5/272頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | SPARTAN-3A FPGA 1M STD 256-FTBGA |
| 產(chǎn)品培訓(xùn)模塊： | Extended Spartan 3A FPGA Family |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | Spartan®-3 |
| LAB/CLB數(shù)： | 1920 |
| 邏輯元件/單元數(shù)： | 17280 |
| RAM 位總計(jì)： | 442368 |
| 輸入/輸出數(shù)： | 173 |
| 門數(shù)： | 1000000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 256-LBGA |
| 供應(yīng)商設(shè)備封裝： | 256-FTBGA |
| 配用： | 122-1502-ND - KIT STARTER SPARTAN-3 PCI-E |
| 其它名稱： | 122-1709 XC3S1000-4FTG256I-ND |
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Spartan-3 FPGA Family: DC and Switching Characteristics
DS099 (v3.1) June 27, 2013
Product Specification
102
Clock Timing
TCCH
CCLK input pin High pulse width
Slave
5
∞
ns
TCCL
CCLK input pin Low pulse width
5
∞
ns
FCCPAR
Frequency of the clock
signal at the CCLK input
pin
No bitstream
compression
Not using the BUSY pin(4)
050
MHz
Using the BUSY pin
0
66
MHz
With bitstream compression
0
20
MHz
During STARTUP phase
0
50
MHz
ΔFCCPAR
Variation from the CCLK output frequency set using the BitGen option
ConfigRate
Master
–50%
+50%
–
Notes:
1.
The numbers in this table are based on the operating conditions set forth in Table 32.
2.
Some Xilinx documents may refer to Parallel modes as "SelectMAP" modes.
3.
RDWR_B is synchronized to CCLK for the purpose of performing the Abort operation. The same pin asynchronously controls the driver
impedance of the D0 - D7 pins. To avoid contention when writing configuration data to the D0 - D7 bus, do not bring RDWR_B High when
CS_B is Low.
4.
In the Slave Parallel mode, it is necessary to use the BUSY pin when the CCLK frequency exceeds this maximum specification.
Table 67: Timing for the Master and Slave Parallel Configuration Modes (Cont’d)
Symbol
Description
Slave/
Master
All Speed Grades
Units
Min
Max
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EMC43DRXH-S734 | CONN EDGECARD 86POS DIP .100 SLD |
| 6-5174681-7 | CONN D-PLUG FEM SCKT 68POS VERT |
| NCV8509PDW26R2 | IC REG LDO 5V/2.6V 16SOIC |
| TACL475M003H | CAP TANT 4.7UF 3V 20% 0603 |
| GBC22DRTN-S13 | CONN EDGECARD 44POS .100 EXTEND |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC3S1000-4PQ208C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA |
| XC3S1000-4PQ208I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA |
| XC3S1000-4PQG208C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA Family: Complete Data Sheet |
| XC3S1000-4PQG208I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA Family: Complete Data Sheet |
| XC3S1000-4TQ144C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-3 FPGA |
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