參數(shù)資料
型號(hào)： XC3S5000-5FGG676C
廠商： Xilinx Inc
文件頁(yè)數(shù)： 270/272頁(yè)
文件大?。?/td> 0K
描述： SPARTAN-3A FPGA 5M 676-FBGA
產(chǎn)品培訓(xùn)模塊： Extended Spartan 3A FPGA Family
標(biāo)準(zhǔn)包裝： 40
系列： Spartan®-3
LAB/CLB數(shù)： 8320
邏輯元件/單元數(shù)： 74880
RAM 位總計(jì)： 1916928
輸入/輸出數(shù)： 489
門數(shù)： 5000000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 676-BGA
供應(yīng)商設(shè)備封裝： 676-FBGA（27x27）
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Spartan-3 FPGA Family: DC and Switching Characteristics
DS099 (v3.1) June 27, 2013
Product Specification
97
Phase Shifter (PS)
Phase shifter operation is only supported if the DLL is in low-frequency mode, see Table 58. Fixed phase shift requires ISE
software version 10.1.03 (or later).
Table 62: Recommended Operating Conditions for the PS in Variable Phase Mode
Symbol
Description
Frequency Mode/
FCLKIN Range
Speed Grade
Units
-5
-4
Min
Max
Min
Max
Operating Frequency Ranges
PSCLK_FREQ
(FPSCLK)
Frequency for the
PSCLK input
Low
1
167
1
167
MHz
Input Pulse Requirements
PSCLK_PULSE
PSCLK pulse width
as a percentage of
the PSCLK period
Low
FCLKIN ≤ 100 MHz
40%
60%
40%
60%
-
FCLKIN > 100 MHz
45%
55%
45%
55%
-
Table 63: Switching Characteristics for the PS in Variable or Fixed Phase Shift Mode
Symbol
Description
Frequency Mode/
FCLKIN Range
Speed Grade
Units
-5
-4
Min
Max
Min
Max
Phase Shifting Range
FINE_SHIFT_RANGE
Phase shift range
Low
–
10.0
–10.0
ns
Lock Time
LOCK_DLL_PS
When using the PS in conjunction
with the DLL: The time from
deassertion at the DCM’s Reset
input to the rising transition at its
LOCKED output. When the DCM
is locked, the CLKIN and CLKFB
signals are in phase.
18 MHz
≤ FCLKIN ≤ 30 MHz
–3.28
ms
30 MHz
< FCLKIN ≤ 40 MHz
–2.56
ms
40 MHz
< FCLKIN ≤ 50 MHz
–1.60
ms
50 MHz
< FCLKIN ≤ 60 MHz
–1.00
ms
60 MHz
< FCLKIN ≤ 165 MHz
–0.88
ms
LOCK_DLL_PS_FX
When using the PS in conjunction
with the DLL and DFS: The time
from deassertion at the DCM’s
Reset input to the rising transition
at its LOCKED output. When the
DCM is locked, the CLKIN and
CLKFB signals are in phase.
Low
–
10.40
–
10.40
ms
Notes:
1.
The numbers in this table are based on the operating conditions set forth in Table 32 and Table 62.
2.
The PS specifications in this table apply when the PS attribute CLKOUT_PHASE_SHIFT= VARIABLE or FIXED.
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PDF描述
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XC3S500E-4CP132C 制造商:Xilinx 功能描述:FPGA SPARTAN-3E 500K GATES 10476 CELLS 572MHZ 90NM 1.2V 132C - Trays
XC3S500E-4CP132CES 制造商:Xilinx 功能描述:
XC3S500E-4CP132I 制造商:Xilinx 功能描述:FPGA SPARTAN-3E 500K GATES 10476 CELLS 572MHZ 90NM 1.2V 132C - Trays
XC3S500E-4CPG132C 功能描述:IC SPARTAN-3E FPGA 500K 132CSBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Spartan®-3E 標(biāo)準(zhǔn)包裝:60 系列:XP LAB/CLB數(shù):- 邏輯元件/單元數(shù):10000 RAM 位總計(jì):221184 輸入/輸出數(shù):244 門數(shù):- 電源電壓:1.71 V ~ 3.465 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:388-BBGA 供應(yīng)商設(shè)備封裝:388-FPBGA（23x23） 其它名稱:220-1241
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