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參數(shù)資料
型號： XRT91L34IVTR-F
廠商： Exar Corporation
文件頁數(shù)： 24/38頁
文件大小： 0K
描述： IC MULTIRATE CDR QUAD 128LQFP
標(biāo)準(zhǔn)包裝： 750
類型： 時鐘和數(shù)據(jù)恢復(fù)（CDR），扇出緩沖器（分配），多路復(fù)用器
PLL： 是
主要目的： SONET/SDH，STS，STM
輸入： LVDS，LVPECL
輸出： LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 622.08MHz
電源電壓： 1.71 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 128-LQFP
供應(yīng)商設(shè)備封裝： 128-LQFP（14x14）
包裝： 帶卷 (TR)
XRT91L34
30
QUAD CHANNEL MULTIRATE STS-12/3/1 AND STM-4/1/0 SONET/SDH CDR
REV. 1.0.1
CHANNELIZED REGISTERS
NOTE: n denotes channel number.
TABLE 15: MICROPROCESSOR INTERFACE REGISTER 0X08, 0X10, 0X18, 0X20 BIT DESCRIPTION
CHANNEL CONTROL REGISTER (CH0 = 0X08, CH1 = 0X10, CH2 = 0X18, CH3 = 0X20)
BIT
NAME
FUNCTION
Register
Type
Default
Value
(HW reset)
D7
Reserved
This Register Bit is Not Used
RO
0
D6
Reserved
This Register Bit is Not Used
RO
0
D5
Reserved
This Register Bit is Not Used
RO
0
D4
Reserved
This Register Bit is Not Used
RO
0
D3
Reserved
This Register Bit is Not Used
RO
0
D2
RCLKDISn
Recovered Serial Clock Output Disable
This bit is used to control the activity of the 622.08/155.52/51.84
MHz differential serial clock output. Tristating RXCLKOnP/N output
reduces power consumption.
"0" = RXCLKOnP/N output Enabled
"1" = RXCLKOnP/N output Tristated
R/W
0
D1
CDRDISn
Clock and Data Recovery Unit Disable
Disables Internal Clock and Data Recovery Unit.
"0" = Internal CDR Unit is Enabled
"1" = Internal CDR Unit is Disabled
R/W
0
D0
POLn
Polarity for SDEXT Input
Controls the Signal Detect polarity convention of SDEXT.
"0" = SDEXT is active "Low"
"1" = SDEXT is active "High"
R/W
0
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PDF描述
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XRT91L80IB-F 功能描述:總線收發(fā)器 Transceiver RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel
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