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參數(shù)資料
| 型號： | Z80L182 |
| 廠商： | ZiLOG, Inc. |
| 英文描述： | CAP .0001UF 50V POLYPROPYLENE |
| 中文描述： | ZiLOG的智能外設(shè)控制器（郵編⑩） |
| 文件頁數(shù)： | 92/109頁 |
| 文件大小： | 738K |
| 代理商： | Z80L182 |
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3-92
Z80182/Z8L182
Z
ILOG
I
NTELLIGENT
P
ERIPHERAL
P R E L I M I N A R Y
Zilog
DS971820600
Z8S180 AC CHARACTERISTICS
(Continued)
Z8L180
20 MHz
Min
Z8S180
33 MHz
Min
No.
Sym
Parameter
Max
Max
Unit
Note
41
42
43
44
45
tRFD1
tRFD2
tHAD1
tHAD2
tDRQS
Clock Rise to /RFSH Fall Delay
Clock Rise to /RFSH Rise Delay
Clock Rise to /HALT Fall Delay
Clock Rise to /HALT Rise Delay
/DREQ Setup Time to Clock Rise
20
20
15
15
15
15
15
15
ns
ns
ns
ns
ns
20
15
46
47
48
49
50
tDRQH
tTED1
tTED2
tED1
tED2
/DREQ Hold Time fromClock Rise
Clock Fall to /TENDi Fall Delay
Clock Fall to /TENDi Rise Delay
Clock Rise to E Rise Delay
Clock Edge to E Fall Delay
20
15
ns
ns
ns
ns
ns
25
25
30
30
15
15
15
15
51
52
53
54
55
PWEH
PWEL
tEr
tEf
tTOD
E Pulse Width (High)
E Pulse Width (Low)
Enable Rise Time
Enable Fall Time
Clock Fall to Timer Output Delay
25
50
20
40
ns
ns
ns
ns
ns
10
10
75
10
10
50
56
tSTDI
CSI/OTx Data Delay Time
(Internal Clock Operation)
CSI/OTx Data Delay Time
(External Clock Operation)
CSI/ORx Data Setup Time
(Internal Clock Operation)
75
60
ns
57
tSTDE
7.5 tcyc+100
7.5 tcyc+100 ns
58
tSRSI
1
1
tcyc
59
tSRHI
CSI/ORx Data Hold Time
(Internal Clock Operation)
CSI/ORx Data Setup Time
(External Clock Operation)
CSI/ORx Data Hold Time
(External Clock Operation)
1
1
tcyc
60
tSRSE
1
1
tcyc
61
tSRHE
1
1
tcyc
62
63
64
65
tRES
tREH
tOSC
tEXr
/RESET Setup time to Clock Fall
/RESET Hold time fromClock Fall
Oscillator Stabilization Time
External Clock Rise Time (EXTAL)
40
25
25
15
ns
ns
ms
ns
20
10
20
5
66
67
68
69
70
72
tEXf
tRr
tRf
tIr
tIf
TdCS
TdIOCS
External Clock Fall Time (EXTAL)
/RESET Rise Time
/RESET Fall Time
Input Rise Time (Except EXTAL, /RESET)
Input Fall Time (Except EXTAL, /RESET)
/MREQValid to /ROMCS, /RAMCS Valid Delay
/IORQValid to /IOCS Valid Delay
10
50
50
50
50
15
15
5
50
50
50
50
10
10
ns
ms
ms
ns
ns
ns
ns
[2]
[2]
[2]
[2]
Notes:
These AC parameters values are preliminary and subject to change without notice.
[1]
All specifications reflect 100% output drive (disabled slew rate limiting feature).
[2]
Specification 1 through 5 refer to PHI clock output.
[3]
Exceeds characterization (data propagation delay needs to be analyzed).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| Z8018533FSC | SMART PERIPHERAL CONTROLLERS |
| Z8019533FSC | SMART PERIPHERAL CONTROLLERS |
| Z80185 | SMART PERIPHERAL CONTROLLERS |
| Z8018520FSC | SMART PERIPHERAL CONTROLLERS |
| Z80195 | SMART PERIPHERAL CONTROLLERS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| Z80L18320ASC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| Z80L183AZ033SCRXXXX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| Z80PIO | 制造商:Zilog Inc 功能描述: |
| Z80S183 | 制造商:ZILOG 制造商全稱:ZILOG 功能描述:Family MPU |
| Z80S18333ASC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
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