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參數(shù)資料
| 型號(hào)： | 22004B |
| 英文描述： | ?lanSC520 User＇s Manual? 6.9MB (PDF) |
| 中文描述： | ？lanSC520用戶手冊？ 6.9MB（PDF格式） |
| 文件頁數(shù)： | 93/446頁 |
| 文件大?。?/td> | 7069K |
| 代理商： | 22004B |
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System Address Mapping
élanSC520 Microcontroller User’s Manual
4-15
4.3.4.5
GP Bus I/O Region
The PAR registers must be used to address external I/O devices on the GP bus. GP bus
addressing is implemented with byte granularity, to accommodate devices with very few
registers and very fragmented I/O maps that are typically found in PC/AT-compatible
systems.
When programming PAR registers for GP bus I/O space, it is best to configure the space
on doubleword boundaries. Note that when specifying unaligned byte regions for I/O access,
the software that accesses the regions must directly address the correct byte or bytes. For
example, if a PAR is programmed with an I/O region, and the start address is xxx1h (i.e.,
byte #1), when the CPU performs a word or doubleword access starting at xxx0h (i.e., byte
#0), the entire doubleword access is redirected to the PCI bus (byte #1 will not be accessed
on the GP bus as programmed). In this case, the byte requested mustbe directly accessed
by the CPU at I/O address xxx1h.
This region is not accessible by PCI bus masters.
4.3.5
Configuration Information
4.3.5.1
Configuring ROM/Flash Space
There are three ROM address regions that can be defined in the élanSC520 microcontroller,
but only the BOOTCS region is absolutely required for system boot up from reset. The
optional two regions, ROMCS1 and ROMCS2 are configured via PAR registers. BOOTCS
configuration is described in Chapter 3, “System Initialization”. See “Programmable
Address Region (PAR) Registers” on page 4-5 for details on PAR register programming.
4.3.5.2
Configuring SDRAM Address Space
SDRAM space is determined at boot time when the SDRAM controller’s configuration
registers are programmed and individual banks are enabled. A typical design can perform
an SDRAM sizing routine to determine the amount of memory installed in the system and
write the appropriate values to the configuration registers. For example, in a system that
contains 16 megabytes of SDRAM, initialization software defines the SDRAM address
region from 00000000–00FFFFFFh, and all accesses to this region are forwarded to the
SDRAM controller unless a PAR register has been programmed to overlay the region with
MMCR, ROM, PCI bus, or GP bus space.
4.3.5.2.1
Noncacheable, Write-Protected, or Nonexecutable SDRAM Regions
In the default condition, the entire SDRAM region is cacheable and executable by the CPU,
and read/writable by the CPU, PCI bus master, and GP bus DMA controller cycles. There
may be some system configurations in which specific portions of SDRAM require restricted
access which can be accomplished by enabling specific attributes. A few common examples
follow:
I
An SDRAM region that contains only code can be marked as write-protected with an
attribute in the PAR register. This prevents the CPU and any bus master from illegally
writing over the code in SDRAM due to faulty programming. In addition, an interrupt can
be generated to the CPU when a violation occurs to assist in debug of the illegal write
condition.
I
An SDRAM region that contains only data can be marked as nonexecutable with an
attribute in the PAR register. If a software task attempts to branch to that location and
resume execution due to a software bug, the CPU will read an illegal opcode, forcing an
exception. The exception handler will then facilitate debugging the program that caused
the illegal condition.
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| 220-04E10-4PN | 功能描述:環(huán)形MIL規(guī)格連接器 REAR MT JAM NUT WALL STANDARD ENV PINS RoHS:否 制造商:Amphenol MIL 類型:MIL-DTL-5015 系列:97 產(chǎn)品類型:Receptacles 外殼大小:28 外殼類型:Potting 觸點(diǎn)類型:Socket (Female) 位置/觸點(diǎn)數(shù)量:14 插入安排:28-2 觸點(diǎn)材料:Copper Alloy 觸點(diǎn)電鍍:Silver 安裝角:Straight 安裝風(fēng)格:Wire 端接類型:Solder 電流額定值: |
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