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參數(shù)資料
| 型號： | 30144-23 |
| 廠商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Geode⑩ GXLV Processor Series Low Power Integrated x86 Solutions |
| 中文描述： | 32-BIT, 200 MHz, MICROPROCESSOR, PBGA352 |
| 封裝： | BGA-352 |
| 文件頁數(shù)： | 201/247頁 |
| 文件大?。?/td> | 4365K |
| 代理商： | 30144-23 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁當(dāng)前第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁
Revision 1.1
201
www.national.com
Electrical Specifications (
Continued
)
G
Figure 6-7. Output Timing
Figure 6-8. Input Timing
Table 6-16. PCI Interface Signals (Refer to Figures 6-7 and 6-8)
Symbol
Parameter
Min
Max
Unit
Comments
t
VAL1
t
VAL2
t
ON
t
OFF
t
SU1
t
SU2
t
H
Notes:
1. GNT# and REQ# are point-to-point signals. All other PCI interface signals are bused.
Refer to Chapter 4 of PCI Local Bus Specification, Revision 2.1, for more detailed information.
Delay Time, SYSCLK to Signal Valid for Bused Signals
2
11
ns
Delay Time, SYSCLK to Signal Valid for GNT#
2
9
ns
Notes 1, 2
Delay Time, Float to Active
2
ns
Delay Time, Active to Float
28
ns
Input Setup Time for Bused Signals
7
ns
Input Setup Time for REQ#
6
ns
Notes 1, 2
Input Hold Time to SYSCLK
0
ns
2. Maximum timings are improved over the PCI Local Bus Specification, Revision 2.1. This allows a PAL or
some other circuit to use a REQ/GNT pair to expand the number of REQ/GNT pairs available to the sys-
tem (See application note,
“
GXLV Processor Series: Request/Grant Pair Expansion
”
.
SYSCLK
TRI-STATE
OUTPUT
OUTPUT
t
VAL1,2
t
OFF
t
ON
SYSCLK
INPUT
t
H
t
SU1,2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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