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參數(shù)資料
| 型號： | 78Q8430-100IGTR/F |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 64/88頁 |
| 文件大小： | 0K |
| 描述： | IC LAN MEDIA ACCESS CTLR 100LQFP |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 1,000 |
| 控制器類型： | 以太網(wǎng)控制器，MAC/PHY |
| 電源電壓： | 3.3V |
| 電流 - 電源： | 230mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應商設備封裝： | 100-LQFP（14x14） |
| 包裝： | 帶卷 (TR) |
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DS_8430_001
78Q8430 Data Sheet
Rev. 1.2
67
7.6.25 Host Not Responding Count Register
Name: HNRCR
Reset Val: 0x0000_0000
Block: CTL
Address: 0x188
Bits
Type
Default
Description
31:0
RW
Count
Number of system cycles to wait for the host to respond to a wake
condition before sending an HNR response.
7.6.26 Wake Up Status Register
Name: WUSR
Reset Val: 0x0000_0000
Block: CTL
Address: 0x18C
Bits
Type
Default
Description
31:8
X
Reserved
7:0
RO
Class
The classification result that triggered the wake up event.
7.6.27 Water Mark Values Register
Name: WMVR
Reset Val: 0x0000_0400
Block: CTL
Address: 0x190
Bits
Type
Default
Description
31
X
Reserved
30:24
RO
0x7D
Free
A count of the number of free memory blocks in the memory manager.
23
X
Reserved
22:16
RW
0x00
Interrupt
Minimum number of free blocks before the host is interrupted.
15
X
Reserved
14:8
RW
0x04
Headroom
Minimum number of free blocks before the MAC receiver is halted.
7
X
Reserved
6:0
RW
0x00
PAUSE
Minimum number of free blocks before the PAUSE packet is sent.
Note: For all watermarks, a value of zero will disable the related feature.
7.6.28 Power Management Capabilities
Name: PMCAP
Reset Val: 0x120A_4801
Block: CTL
Address: 0x198
Bits
Type
Default
Description
31:27
RO
0x02
Support
Power management events supported. This field always reads back
00010b to indicate
PME from D1 is supported.
26
RO
0
D2 Support
Reads back 0 to indicate D2 is not supported.
25
RO
1
D1 Support
Reads back 1 to indicate D1 is supported.
24:20
RO
0x00
Init
Reads back 00000b to indicate no device specific initialization.
19
RO
1
CLK
Reads back 1 to indicate the clock (BUSCLK) is needed for
PME
operation.
18:16
RO
010
VER
Reads back 010b to indicate specification version 1.1 compliance.
相關PDF資料 |
PDF描述 |
|---|---|
| GRM2165C1H510JZ01D | CAP CER 51PF 50V 5% NP0 0805 |
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| MAX5984DETI+T | IC CTRLR PD IEEE W/MOSFT 28TQFN |
| PIC16HV785-E/P | IC PIC MCU FLASH 2KX14 20DIP |
| MAX5984AETI+T | IC CTRLR PD IEEE W/MOSFT 28TQFN |
相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 78Q8430-128CGT/F | 制造商:Maxim Integrated Products 功能描述:Ethernet ICs 10/100 Ethernet MAC & PHY |
| 78Q8430-128CGTR/F | 制造商:Maxim Integrated Products 功能描述:Ethernet ICs 10/100 Ethernet MAC & PHY |
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