參數(shù)資料
型號(hào)： 82C836A
廠商： Electronic Theatre Controls, Inc.
英文描述： Single-Chip 386sx AT
中文描述： 單芯片386sx在
文件頁(yè)數(shù)： 8/205頁(yè)
文件大?。?/td> 3878K
代理商： 82C836A
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Figure 8-5.
Figure 8-6.
Figure 8-7.
Figure 8-8.
Request Register Read Format . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-13
Request Mask Register ----Write Single Mask Bit . . . . . . . . . . . . . 8-13
Request Mask Register ----Write All Mask Bits . . . . . . . . . . . . . . . 8-14
Status Register (Read Only) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-15
System Timing Relationships
Figure 11-1.
Figure 11-2.
Figure 11-3.
Figure 11-4.
Figure 11-5.
Figure 11-6.
Figure 11-7.
Figure 11-8.
Figure 11-9.
Figure 11-10.
Figure 11-11.
Figure 11-12.
Figure 11-13.
Figure 11-14.
Figure 11-15.
Figure 11-16.
Figure 11-17.
Figure 11-18.
Figure 11-19.
CPU Access to AT-Bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-2
-MEMCS16 and -IOCS16 Timing . . . . . . . . . . . . . . . . . . . . . . . . 11-3
-NA/-STCYC Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-5
-MEMCS16 and -IOCS16 Timing . . . . . . . . . . . . . . . . . . . . . . . . 11-7
IOCHRDY and -0WS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-8
-CAS-Only DRAM Access by CPU . . . . . . . . . . . . . . . . . . . . . . . 11-11
Local DRAM Bank Switch . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-13
Maximum Wait State Page Miss . . . . . . . . . . . . . . . . . . . . . . . . . 11-15
Cache Mode Write Cycles . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-17
Early READY and -LBA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-18
Coprocessor Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-19
DMA Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
DMA and Master Access to Local Memory . . . . . . . . . . . . . . . . . 11-23
DRQ/DACK Scanning in MRA Mode . . . . . . . . . . . . . . . . . . . . . 11-25
Master Arbitration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-26
Refresh Timing (HLDA/14MHz-Based) . . . . . . . . . . . . . . . . . . . 11-29
Hidden Refresh (PROCCLK-Based, No HLDA) . . . . . . . . . . . . . 11-31
Standby Refresh (32KHz-Based) . . . . . . . . . . . . . . . . . . . . . . . . . 11-33
Power-On . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
11-21
11-34
Timing Diagrams
Figure 13-1.
Figure 13-2.
Timing Waveforms . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13-1
CPU to Local Memory ----Output Responses and
Input Requirements . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13-2
CPU AT-Bus, On-Board I/O and ROM ----Output Responses . . . 13-3
CPU to AT-Bus, On-Board I/O and ROM ----Input Requirements 13-4
DMA to AT-Bus, On-Board I/O, and ROM ----Output Responses 13-5
DMA to AT-Bus, On-Board I/O and ROM ----Input Requirements 13-6
DMA and AT-Bus Master Access to Local Memory ----
Output Responses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13-6
DMA and AT-Bus Master Access to Local Memory ----
Input Requirements . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13-7
Refresh----Input Requirements . . . . . . . . . . . . . . . . . . . . . . . . . . . 13-7
Refresh----Output Responses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13-8
Miscellaneous Parameters ----Output Responses . . . . . . . . . . . . . . 13-9
Miscellaneous Parameters ----Input Requirements . . . . . . . . . . . . . 13-10
Local Bus Access and Cache ----Output Responses . . . . . . . . . . . . 13-10
Local Bus Access and Cache ----Input Requirements . . . . . . . . . . 13-11
Standby Refresh----Output Responses . . . . . . . . . . . . . . . . . . . . . . 13-11
Figure 13-3.
Figure 13-4.
Figure 13-5.
Figure 13-6.
Figure 13-7.
Figure 13-8.
Figure 13-9.
Figure 13-10.
Figure 13-11.
Figure 13-12.
Figure 13-13.
Figure 13-14.
Figure 13-15.
Mechanical Specifications
Figure 14-1.
Package Dimensions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14-1
I
Contents
82C836 CHIPSet Data Sheet
x
Revision 3.0
P R E L I M I N A R Y
Chips and Technologies, Inc.
相關(guān)PDF資料
PDF描述
82C836A-16 Single-Chip 386sx AT
82C836A-20 Single-Chip 386sx AT
82C836B Single-Chip 386sx AT
82C862 FireLink USB Dual Controller Quad Port USB
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參數(shù)描述
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82C836A-20 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Single-Chip 386sx AT
82C836B 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Single-Chip 386sx AT
82C83H 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS Octal Latching Inverting Bus Driver
82C84 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS Clock Generator Driver
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