- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄10031 > AD6654CBCZ (Analog Devices Inc)IC ADC 14BIT W/4CH RSP 256CSPBGA PDF資料下載
參數(shù)資料
| 型號(hào)： | AD6654CBCZ |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 3/88頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC ADC 14BIT W/4CH RSP 256CSPBGA |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 位數(shù)： | 14 |
| 采樣率（每秒）： | 92.16M |
| 數(shù)據(jù)接口： | 串行，并聯(lián) |
| 轉(zhuǎn)換器數(shù)目： | 1 |
| 功率耗散（最大）： | 2.5W |
| 電壓電源： | 模擬和數(shù)字 |
| 工作溫度： | -25°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 256-CSPBGA（17x17） |
| 包裝： | 托盤 |
| 輸入數(shù)目和類型： | 1 個(gè)差分，單極 |
第1頁(yè)第2頁(yè)當(dāng)前第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)
AD6654
Rev. 0 | Page 11 of 88
SERIAL PORT TIMING CHARACTERISTICS
Table 9.
Temp
Test Level
Min
Typ
Max
Unit
SERIAL PORT CLOCK TIMING REQUIREMENTS
tSCLK
SCLK Period
Full
IV
10.0
ns
tSCLKL
SCLK Low Time
Full
IV
1.60
0.5 × tSCLK
ns
tSCLKH
SCLK High Time
Full
IV
1.60
0.5 × tSCLK
ns
SPI PORT CONTROL TIMING REQUIREMENTS (MODE = 0)
tSSDI
SDI to
↑SCLK Setup Time
Full
IV
1.30
ns
tHSDI
SDI to
↑SCLK Hold Time
Full
IV
0.40
ns
tSSCS
SCS to
↑SCLK Setup Time
Full
IV
4.12
ns
tHSCS
SCS to
↑SCLK Hold Time
Full
IV
2.78
ns
tDSDO
↑SCLK to SDO Delay Time
Full
IV
4.28
7.96
ns
SPORT MODE CONTROL TIMING REQUIREMENTS (MODE = 1)
tSSDI
SDI to
↑SCLK Setup Time
Full
IV
0.80
ns
tHSDI
SDI to
↑SCLK Hold Time
Full
IV
0.40
ns
tSSRFS
SRFS to
↓SCLK Setup Time
Full
IV
1.60
ns
tHSRFS
SRFS to
↓SCLK Hold Time
Full
IV
0.13
ns
tSSTFS
STFS to
↓SCLK Setup Time
Full
IV
1.60
ns
tHSTFS
STFS to
↓SCLK Hold Time
Full
IV
0.30
ns
tSSCS
SCS to
↑SCLK Setup Time
Full
IV
4.12
ns
tHSCS
SCS to
↑SCLK Hold Time
Full
IV
2.76
ns
tDSDO
↑SCLK to SDO Delay Time
Full
IV
4.29
7.95
ns
1 All timing specifications are valid over the VDDCORE range of 1.7 V to 1.9 V and the VDDIO range of 3.0 V and 3.6 V.
2 CLOAD = 40 pF on all outputs, unless otherwise noted.
3 SCLK rise/fall time should be 3 ns maximum.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MS27467T21A16PA | CONN PLUG 16POS STRAIGHT W/PINS |
| VE-21J-IU-F1 | CONVERTER MOD DC/DC 36V 200W |
| MS3100R28-21S | CONN RCPT 37POS WALL MNT W/SCKT |
| VI-26H-MX-F4 | CONVERTER MOD DC/DC 52V 75W |
| VE-21H-IU-F3 | CONVERTER MOD DC/DC 52V 200W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD6654XBCZ | 制造商:Analog Devices 功能描述:14-BIT, 92.16 MSPS, 4 & 6-CHANNEL WIDEBAND IF TO BASE BAND R - Bulk |
| AD6655 | 制造商:AD 制造商全稱:Analog Devices 功能描述:IF Diversity Receiver |
| AD6655-125EBZ | 功能描述:BOARD EVAL W/AD6655 & SOFTWARE RoHS:是 類別:RF/IF 和 RFID >> RF 評(píng)估和開(kāi)發(fā)套件，板 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 類型:GPS 接收器 頻率:1575MHz 適用于相關(guān)產(chǎn)品:- 已供物品:模塊 其它名稱:SER3796 |
| AD6655-125EBZ1 | 制造商:AD 制造商全稱:Analog Devices 功能描述:IF Diversity Receiver |
| AD6655-150EBZ | 功能描述:BOARD EVAL FOR 150MSPS AD6655 RoHS:是 類別:RF/IF 和 RFID >> RF 評(píng)估和開(kāi)發(fā)套件，板 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 類型:GPS 接收器 頻率:1575MHz 適用于相關(guān)產(chǎn)品:- 已供物品:模塊 其它名稱:SER3796 |
發(fā)布緊急采購(gòu)，3分鐘左右您將得到回復(fù)。