JTAG Test Access Port and Emulation For JTAG Test Access Port and Emulation, see Table 28 and Figure 26. Table 28. JTAG" />
參數(shù)資料
型號(hào)： ADSP-21160NKBZ-100
廠商： Analog Devices Inc
文件頁數(shù)： 33/48頁
文件大小： 0K
描述： IC DSP CONTROLLER 32BIT 400-BGA
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點(diǎn)
接口： 主機(jī)接口，連接端口，串行端口
時(shí)鐘速率： 100MHz
非易失內(nèi)存： 外部
芯片上RAM： 512kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.90V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 托盤
–39–
REV. 0
ADSP-21160N
JTAG Test Access Port and Emulation
For JTAG Test Access Port and Emulation, see Table 28 and
Table 28. JTAG Test Access Port and Emulation
Parameter
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
tCK
ns
tSTAP
TDI, TMS Setup Before TCK High
5
ns
tHTAP
TDI, TMS Hold After TCK High
6
ns
tSSYS
System Inputs Setup Before TCK Low
1
7ns
tHSYS
System Inputs Hold After TCK Low
18
ns
tTRSTW
TRST Pulsewidth
4tCK
ns
Switching Characteristics
tDTDO
TDO Delay from TCK Low
13
ns
tDSYS
System Outputs Delay After TCK Low
2
30
ns
1 System Inputs = DATA63–0, ADDR31–0,
RDx, WRx, ACK, SBTS, HBR, HBG, CS, DMAR1, DMAR2, BR6–1, ID2–0, RPBA, IRQ2–0, FLAG3–0,
PA, BRST, DR0, DR1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, LxDAT7–0, LxCLK, LxACK, EBOOT, LBOOT, BMS,
CLKIN,
RESET.
2 System Outputs = DATA63–0, ADDR31–0,
MS3–0, RDx, WRx, ACK, PAGE, CLKOUT, HBG, REDY, DMAG1, DMAG2, BR6–1, PA, BRST, CIF,
FLAG3–0, TIMEXP, DT0, DT1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, LxDAT7–0, LxCLK, LxACK,
BMS.
Figure 26. JTAG Test Access Port and Emulation
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
tSTAP
tTCK
tHTAP
tDTDO
tSSYS
tHSYS
tDSYS
相關(guān)PDF資料
PDF描述
ADSP-21062LCSZ-160 IC DSP CONTROLLER 32BIT 240MQFP
AGM25DTBD CONN EDGECARD 50POS R/A .156 SLD
AYM25DTAN CONN EDGECARD 50POS R/A .156 SLD
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參數(shù)描述
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