參數(shù)資料
型號: ADSP-BF548BBCZ-5A
廠商: Analog Devices Inc
文件頁數(shù): 43/100頁
文件大小: 0K
描述: IC DSP 16BIT 533MHZ 400CSBGA
產(chǎn)品培訓(xùn)模塊: Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標(biāo)準(zhǔn)包裝: 1
系列: Blackfin®
類型: 定點(diǎn)
接口: CAN,SPI,SSP,TWI,UART,USB
時鐘速率: 533MHz
非易失內(nèi)存: 外部
芯片上RAM: 260kB
電壓 - 輸入/輸出: 2.50V,3.30V
電壓 - 核心: 1.25V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 400-LFBGA,CSPBGA
供應(yīng)商設(shè)備封裝: 400-CSPBGA(17x17)
包裝: 托盤
配用: ADSP-3PARCBF548M01-ND - MODULE BOARD BF548
ADSP-3PARCBF548E02-ND - KIT DEV STARTER BF548
ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. C
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February 2010
Table 31. Asynchronous Memory Write Cycle Timing with Asynchronous ARDY
Parameter
Min
Max
Unit
Timing Requirements
tDANW
ARDY Negated Delay from AMSx Asserted
1
(S + WA – 2)
× t
SCLK ns
tHAA
ARDY Asserted Hold After AWE Negated
0.0
ns
Switching Characteristics
tDDAT
DATA15 – 0 Disable After CLKOUT
6.0
ns
tENDAT
DATA15 – 0 Enable After CLKOUT
0.0
ns
tDO
Output Delay After CLKOUT
2
6.0
ns
tHO
Output Hold After CLKOUT
0.3
ns
1 S = number of programmed setup cycles, WA = number of programmed write access cycles.
2 Output pins include AMS3–0, ABE1–0, ADDR19–1, AOE, and AWE.
Figure 16. Asynchronous Memory Write Cycle Timing with Asynchronous ARDY
SETUP
2 CYCLES
PROGRAMMED
WRITE ACCESS
2 CYCLES
ACCESS
EXTENDED
2 CYCLES
HOLD
1 CYCLE
tDO
tHO
CLKOUT
AMSx
ABE1–0
ADDR19–1
AWE
ARDY
DATA 15–0
tDO
tDDAT
tENDAT
tHO
tDANW
tHAA
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