參數(shù)資料
型號： ADSP-BF548BBCZ-5A
廠商： Analog Devices Inc
文件頁數(shù)： 54/100頁
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描述： IC DSP 16BIT 533MHZ 400CSBGA
產(chǎn)品培訓模塊： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標準包裝： 1
系列： Blackfin®
類型： 定點
接口： CAN，SPI，SSP，TWI，UART，USB
時鐘速率： 533MHz
非易失內(nèi)存： 外部
芯片上RAM： 260kB
電壓 - 輸入/輸出： 2.50V，3.30V
電壓 - 核心： 1.25V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 400-LFBGA，CSPBGA
供應商設備封裝： 400-CSPBGA（17x17）
包裝： 托盤
配用： ADSP-3PARCBF548M01-ND - MODULE BOARD BF548
ADSP-3PARCBF548E02-ND - KIT DEV STARTER BF548
ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. C
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February 2010
Synchronous Burst AC Timing
Table 38 and Figure 28 on Page 57 describe Synchronous Burst
AC operations.
Table 38. Synchronous Burst AC Timing
Parameter
Min
Max
Unit
Timing Requirements
tNDS
DATA15-0 Setup Before NR_CLK
4.0
ns
tNDH
DATA15-0 Hold After NR_CLK
2.0
ns
tNWS
WAIT Setup Before NR_CLK
8.0
ns
tNWH
WAIT Hold After NR_CLK
0.0
ns
Switching Characteristics
tNDO
AMSx, ABE1-0, ADDR19-1, NR_ADV, NR_OE Output Delay After NR_CLK
6.0
ns
tNHO
ABE1-0, ADDR19-1 Output Hold After NR_CLK
–3.0
ns
Figure 28. Synchronous Burst AC Interface Timing
tNDO
tNDO
tNDO
tNWS
tNWH
tNDO
tNHO
tNDH
tNDH
tNDS
tNDS
tNDO
tNHO
Dn
Dn+1
Dn+2
Dn+3
AMSx
NR_CLK
ABE1-0
ADDR19-1
DATA15-0
NR_ADV
NR_OE
WAIT
NOTE: NR_CLK dotted line represents a free running version of NR_CLK that is not visible on the NR_CLK pin.
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參數(shù)描述
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ADSP-BF549BBCZ 制造商:Analog Devices 功能描述:
ADSP-BF549BBCZ-ENG 制造商:Analog Devices 功能描述:- Bulk
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