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參數(shù)資料
| 型號(hào)： | CS61884-IRZ |
| 廠商： | Cirrus Logic Inc |
| 文件頁數(shù)： | 4/72頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LN INTERF T1/E1/J1 160-LFBGA |
| 標(biāo)準(zhǔn)包裝： | 126 |
| 功能： | 線路接口單元（LIU） |
| 接口： | E1，J1，T1 |
| 電路數(shù)： | 8 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 功率（瓦特）： | 1.73W |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 160-LFBGA |
| 供應(yīng)商設(shè)備封裝： | 160-TFGBA（13x13） |
| 包裝： | 散裝 |
| 包括： | AMI 編碼器和解碼器，B8ZS 編碼器和解碼器，HDB3 編碼器和解碼器，LOS 檢測(cè) |
| 產(chǎn)品目錄頁面： | 759 (CN2011-ZH PDF) |
| 其它名稱： | 598-1717 |
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CS61884
12
DS485F3
WR/DS/SDI/LEN0
84
J14
I
Data Strobe/ Write Enable/Serial Data/Line Length Input
Intel Parallel Host Mode - This pin “WR” functions as a
write enable.
Motorola Parallel Host Mode - This pin “DS“ functions as
a data strobe input.
Serial Host Mode - This pin “SDI” functions as the serial
data input.
Hardware Mode - As LEN0, this pin controls the transmit
pulse shapes for both E1 and T1/J1 modes. This pin also
selects which mode is used E1 or T1/J1 (Refer to Table 5
RD/RW/LEN1
85
J13
I
Read/Write/ Read Enable/Line Length Input
Intel Parallel Host Mode - This pin “RD” functions as a
read enable.
Motorola Parallel Host Mode - This pin “R/W” functions as
the read/write input signal.
Hardware Mode - As LEN1, this pin controls the transmit
pulse shapes for both E1 and T1/J1 modes. This pin also
selects which mode is used E1 or T1/J1 (Refer to Table 5
ALE/AS/SCLK/LE
N2
86
J12
I
Address Latch Enable/Serial Clock/Address Strobe/Line
Length Input
Intel Parallel Host Mode - This pin “ALE” functions as the
Address Latch Enable when configured for multiplexed ad-
dress/data operation.
Motorola Parallel Host Mode - This pin “AS” functions as
the active “l(fā)ow” address strobe when configured for multi-
plexed address/data operation.
Serial Host Mode - This pin “SCLK” is the serial clock
used for data I/O on SDI and SDO.
Hardware Mode - As LEN2, this pin controls the transmit
pulse shapes for both E1 and T1/J1 modes. This pin also
selects which mode is used E1 or T1/J1 (Refer to Table 5
CS/JASEL
87
J11
I
Chip Select Input/Jitter Attenuator Select
Host Mode - This active low input is used to enable ac-
cesses to the microprocessor interface in either serial or
parallel mode.
Hardware Mode - This pin controls the position of the Jitter
Attenuator.
SYMBOL
LQFP
LFBGA
TYPE
DESCRIPTION
Pin State
Jitter Attenuation Position
LOW
Transmit Path
HIGH
Receive Path
OPEN
Disabled
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PDF描述 |
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參數(shù)描述 |
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