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參數(shù)資料
| 型號： | DS32512N+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 80/130頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU DS3/E3/STS-1 12P 484-BGA |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 30 |
| 類型： | 線路接口裝置（LIU） |
| 規(guī)程： | DS3 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA |
| 供應(yīng)商設(shè)備封裝： | 484-BGA（23x23） |
| 包裝： | 管件 |
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DS32506/DS32508/DS32512
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Bit 3: Global Performance Monitor Register Update (GPMU).
When GLOBAL.CR1:GPM[1:0] = 00, this bit is
used to update all of the performance monitor registers where block-level PMUM = 1 and PORT.CR1:PMUM = 1.
When this bit transitions from low to high, all configured performance monitoring registers are updated with the
latest counter value, and all associated counters are reset. This bit should remain high until the performance
monitor update status bit (GLOBAL.SR:GPMS) goes high, and then it should be brought back low, which clears the
GPMS status bit. If a counter increment occurs at the exact same time as the counter reset, the counter is loaded
with a value of one, and the “counter is non-zero” latched status bit is set. See Section 8.7.4.
Bit 1: Reset Data Path (RSTDP).
When this bit is set, it forces all of the internal data path and status registers in
all ports to their default state. This bit must be set high for a minimum of 100ns. See Section 8.11.
0 = Normal operation
1 = Force all data path registers to their default values
Bit 0: Reset (RST).
When this bit is set, all of the internal data path and status and control registers (except this
RST bit), on all of the ports, are reset to their default state. This bit must be set high for a minimum of 100ns. This
0 = Normal operation
1 = Force all internal registers to their default values
相關(guān)PDF資料 |
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參數(shù)描述 |
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