參數(shù)資料
型號： DS32512N+
廠商： Maxim Integrated Products
文件頁數(shù)： 86/130頁
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描述： IC LIU DS3/E3/STS-1 12P 484-BGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 30
類型： 線路接口裝置（LIU）
規(guī)程： DS3
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 484-BGA
供應(yīng)商設(shè)備封裝： 484-BGA（23x23）
包裝： 管件
DS32506/DS32508/DS32512
59 of 130
Register Name:
GLOBAL.ISR
Register Description:
Global Interrupt Status Register
Register Address:
020h
Bit #
15
14
13
12
11
10
9
8
Name
—
P12ISR
P11ISR
P10ISR
P9ISR
P8ISR
Bit #
7
6
5
4
3
2
1
0
Name
P7ISR
P6ISR
P5ISR
P4ISR
P3ISR
P2ISR
P1ISR
GSR
Bits 12 to 1: Port n Interrupt Status Register (PnISR).
This bit is set when any of the bits in the port n interrupt
status register (PORT.ISR) are set and enabled for interrupt. When set, this bit causes an interrupt if
GLOBAL.ISRIE:PnISRIE is set. See Section 8.10.
Bit 0: Global Status Register (GSR).
This bit is set when any of the latched status register bits in the global
latched status register (GLOBAL.SRL) are set and enabled for interrupt. When set, this bit causes an interrupt if
GLOBAL.ISRIE:GSRIE is set. See Section 8.10.
Register Name:
GLOBAL.ISRIE
Register Description:
Global Interrupt Status Register Interrupt Enable
Register Address:
022h
Bit #
15
14
13
12
11
10
9
8
Name
—
P12ISRIE
P11ISRIE
P10ISRIE
P9ISRIE
P8ISRIE
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
P7ISRIE
P6ISRIE
P5ISRIE
P4ISRIE
P3ISRIE
P2ISRIE
P1ISRIE
GSRIE
Default
0
Bits 12 to 1: Port n Interrupt Status Register Interrupt Enable (PnISRIE).
This bit is the interrupt enable for the
GLOBAL.ISR:PnISR status bit. See Section 8.10.
0 = mask the interrupt
1 = enable the interrupt
Bit 0: Global Status Register Interrupt Enable (GSRIE).
This bit is the interrupt enable for the GLOBAL.ISR:GSR
status bit. See Section 8.10.
0 = mask the interrupt
1 = enable the interrupt
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PDF描述
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參數(shù)描述
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