參數(shù)資料
型號： DSM2150F5V
廠商： 意法半導(dǎo)體
元件分類： 數(shù)字信號處理
英文描述： DSM (Digital Signal Processor System Memory) for Analog Devices DSPs (3.3V Supply)
中文描述： 帝斯曼（數(shù)字信號處理器系統(tǒng)內(nèi)存）的ADI公司的DSP（3.3V電源）
文件頁數(shù)： 57/73頁
文件大?。?/td> 1067K
代理商： DSM2150F5V
57/73
DSM2150F5V
Figure 28. Synchronous Clock Mode Timing
–
PLD
Table 23. CPLD MicroCell Synchronous Clock Mode Timing
Note: 1. Fast slew rate output available on Port C and Port F.
2. CLKIN (PD1) t
CLCL
= t
CH
+ t
CL
.
Symbol
Parameter
Conditions
-12
PT
Aloc
Turbo
Off
Slew
Rate
1
Unit
Min
Max
f
MAX
Maximum Frequency
External Feedback
1/(t
S
+t
CO
)
20.4
MHz
Maximum Frequency
Internal Feedback (f
CNT
)
1/(t
S
+t
CO
–
10)
25.6
MHz
Maximum Frequency
Pipelined Data
1/(t
CH
+t
CL
)
35.7
MHz
t
S
Input Setup Time
23
Add 4
Add 20
ns
t
H
Input Hold Time
0
ns
t
CH
Clock High Time
Clock Input
14
ns
t
CL
Clock Low Time
Clock Input
14
ns
t
CO
Clock to Output Delay
Clock Input
26
Sub 6
ns
t
ARD
CPLD Array Delay
Any MicroCell
27
Add 4
ns
t
MIN
Minimum Clock Period
2
t
CH
+t
CL
28
ns
tCH
tCL
tCO
tH
tS
CLKIN
INPUT
REGISTERED
OUTPUT
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PDF描述
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