參數(shù)資料
型號： DSP56301PW100
廠商： Freescale Semiconductor
文件頁數(shù)： 81/124頁
文件大小： 0K
描述： IC DSP 24BIT FIXED-POINT 208LQFP
標準包裝： 36
系列： DSP563xx
類型： 定點
接口： 主機接口，SSI，SCI
時鐘速率： 100MHz
非易失內(nèi)存： ROM（9 kB）
芯片上RAM： 24kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 208-LQFP
供應商設備封裝： 208-LQFP
包裝： 托盤
DSP56301 Technical Data, Rev. 10
1-2
Freescale Semiconductor
Signals/Connections
Figure 1-1.
Signals Identified by Functional Group
DSP56301
24
External
Address Bus
External
Data Bus
External
Bus
Control
Extended Synchronous
Serial Interface Port 0
(ESSI0)3
Timers4
PLL
JTAG/OnC
E Port
Power Inputs1:
PLL
Internal Logic
Address Bus
Data Bus
Bus Control
HI32
ESSI/SCI/Timer
A[0-23]
D[0-23]
AA[0–3]
RAS[0–3]
RD
WR
BS
TA
BR
BG
BB
BL
CAS
BCLK
TCK
TDI
TDO
TMS
TRST
DE
CLKOUT
PCAP
PINIT/NMI
VCCP
VCCQ
VCCA
VCCD
VCCN
VCCH
VCCS
4
Serial
Communications
Interface (SCI) Port3
4
2
Grounds1:
PLL
Internal Logic
Address Bus
Data Bus
Bus Control
HI32
ESSI/SCI/Timer
GNDP
GNDP1
GNDQ
GNDA
GNDD
GNDN
GNDH
GNDS
4
6
4
2
Interrupt
/Mode
Control
MODA/IRQA
MODB/IRQB
MODC/IRQC
MODD/IRQD
RESET
Host
Interface
(HI32) Port2
PCI Bus
RXD
TXD
SCLK
SC[00-02]
SCK0
SRD0
STD0
TIO0
TIO1
TIO2
52
3
6
2
EXTAL
XTAL
Clock
Extended
Synchronous Serial
Interface Port 1
(ESSI1)3
SC[10-12]
SCK1
SRD1
STD1
3
Universal
Bus
Port B
GPIO
Port E GPIO
PE0
PE1
PE2
Port C GPIO
PC[0-2]
PC3
PC4
PC5
Port D GPIO
PD[0-2]
PD3
PD4
PD5
Timer GPIO
TIO0
TIO1
TIO2
Port A
4
6
See Figure 1-2 for a listing of the
Host Interface/Port B Signals
Notes:
1.
Power and ground connections are shown for the TQFP package. The MAP-BGA package uses one
VCCP for the PLL power input and 44 VCC pins that connect to an internal power plane. The MAP-
BGA package uses two ground connections for the PLL (GNDP and GNDP1) and 36 GND pins that
connect to an internal ground plane.
2.
The HI32 port supports PCI and non-PCI bus configurations. Twenty-four HI32 signals can also be
configured as GPIO signals (PB[0–23]).
3.
The ESSI0, ESSI1, and SCI signals are multiplexed with the Port C GPIO signals (PC[0–5]), Port D
GPIO signals (PD[0–5]), and Port E GPIO signals (PE[0–2]), respectively.
4.
TIO[0–2] can be configured as GPIO signals.
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PDF描述
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VE-26Z-CY-S CONVERTER MOD DC/DC 2V 20W
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EBC17DRTF CONN EDGECARD 34POS DIP .100 SLD
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參數(shù)描述
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