- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377001 > DSP56600 (飛思卡爾半導(dǎo)體(中國)有限公司) Implementing Viterbi Decoders Using the VSL Instruction on DSP Families PDF資料下載
參數(shù)資料
| 型號： | DSP56600 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Implementing Viterbi Decoders Using the VSL Instruction on DSP Families |
| 中文描述： | 維特比解碼器實(shí)現(xiàn)上使用DSP的家庭教學(xué)的VSL |
| 文件頁數(shù)： | 98/108頁 |
| 文件大?。?/td> | 726K |
| 代理商： | DSP56600 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁當(dāng)前第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁
C-6
Viterbi Decoder Implementation
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24-Bit Algorithm Program Listing
;*******************viterbi add, compare, select butterfly macro***
;
FUNCTION: Update path metrics/paths for the Viterbi algorithm by
;
doing an add,compare,select update for state pairs.
;
INPUTS:
;
r2 should point to the beginning of the branch metric table
;
r5 should point to the latest path metric for state 0
;
r4 should point to the storage location for updated state 0
;
n5 should offset addresses by NUMSTATES/2
;
OUTPUTS:
;
Updated path metrics/paths stored in XY memory
;
REGISTERS USED:
;
a,b,y01,r2,r4,r5,n5 r2 unchanged (modulo req'd)
;
Registers:
;
r5, pointer to the path metric/path table, arranged as
;
x: path metric, y: path,states ordered assuming
;
bits shift right to left.
;
r4, pointer to the output path metric/path table
;
r0, pointer to the branch metric table, arranged
;
as x:C, y:D, CD,CD,CD, etc.
;
;
SA------NSA
;
\ C /
;
D \ /
;
\/
;
/\
;
D / \
;
/ \
;
SB------NSB
;
C
;*****************************************************************
;
ACS
macro
;
;
move
#BRY,r2
move
l:(r2)+,y
move
l:(r5)+n5,a
;
do
#NoAcs,_P_NextStage
add
y0,a
l:(r5)-n5,b
add
y1,b
max
a,b
l:(r5)+n5,a
vsl
b,0,l:(r4)+
add
y1,a
l:(r5)-n5,b
add
y0,b
(r5)+
max
a,b
l:(r5)+n5,a
move
l:(r2)+,y
vsl
b,1,l:(r4)+
_P_NextStage
nop
endm
;r2 points to branch metrics
;get first branch metric
;load 1st metric/path pair
;update each state
;get next pair
;update metrics
;reload 1st pair
;end top half
;reload next pair
;inc st ptr
;load next pair
;load next branch metrics
;end 2nd half
;needed to separate do loop ends
Example C-1
24-bit Algorithm Program Listing (Continued)
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
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