Limit at TMIN t" />
參數(shù)資料
型號(hào)： EVAL-ADF4158EB1Z
廠商： Analog Devices Inc
文件頁數(shù)： 33/36頁
文件大小： 0K
描述： BOARD EVALUATION FOR ADF4158
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，頻率合成器
嵌入式： 否
已用 IC / 零件： ADF4158
主要屬性： 單路分?jǐn)?shù)-N PLL
已供物品： 板
ADF4158
Data Sheet
Rev. G | Page 6 of 36
Table 3. Read Timing
Parameter
Limit at TMIN to TMAX (C Version)
Unit
Test Conditions/Comments
t1
20
ns min
TXDATA setup time
t2
20
ns min
CLK setup time to DATA (on MUXOUT)
t3
25
ns min
CLK high duration
t4
25
ns min
CLK low duration
t5
10
ns min
CLK to LE setup time
Read Timing Diagram
CLK
MUXOUT
LE
DB36
DB35
DB1
DB2
DB0
08
72
8-
2
26
t1
t2
TXDATA
NOTES
1. LE SHOULD BE KEPT HIGH DURING READBACK.
t4
t5
t3
Figure 3. Read Timing Diagram
100A
1.5V
IOL
IOH
TO OUTPUT
PIN
CL
10pF
100A
0
87
28
-00
4
Figure 4. Load Circuit for MUXOUT Timing, CL = 10 pF
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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