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參數(shù)資料
| 型號： | IDT82V2108PXG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 243/292頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FRAMER T1/J1/E1 8CH 128-PQFP |
| 標準包裝： | 11 |
| 控制器類型： | T1/E1/J1 調(diào)幀器 |
| 接口： | 并聯(lián) |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 電流 - 電源： | 160mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 128-PQFP（14x20） |
| 包裝： | 托盤 |
| 其它名稱： | 82V2108PXG |
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Functional Description
44
March 5, 2009
3.11.2
T1/J1 MODE
In T1/J1 mode, the Receive System Interface can be set in Non-
multiplexed Mode or Multiplexed Mode. In the Non-multiplexed Mode,
the RSDn pin is used to output the received data from each framer at a
bit rate of 1.544 Mb/s or 2.048 Mb/s (T1/J1 mode E1 rate). While in the
Multiplexed Mode, the received data from the eight framers is converted
to 2.048 Mb/s format and byte-interleaved to form two high speed data
streams and outputs on the MRSD1 and MRSD2 pins at a bit rate of
8.192 Mb/s.
In the Non-multiplexed Mode, if the timing signal for clocking data
on the RSDn pin is provided by the system side and shared by all eight
framers, the Receive System Interface should be set in Receive Clock
Slave mode. If the timing signal for clocking data on each RSDn pin is
received from each line side, the Receive System Interface should be
set in Receive Clock Master mode.
In the Receive Clock Slave mode, if the multi-function pin RSCKn/
RSSIGn is used to output a reference clock, the Receive System Inter-
face is in Receive Clock Slave RSCK Reference Mode. If the RSCKn/
RSSIGn pin is used to output the extracted signaling bits, the Receive
System Interface is in Receive Clock Slave External Signaling mode.
The T1/J1 mode E1 rate, which means the system clock rate is
2.048 MHz in T1/J1 mode, can only be supported in the Receive Clock
Slave mode.
In the Receive Clock Master mode, if the data in all 24 channels of
a T1/J1 basic frame is clocked out by RSCKn, the Receive System Inter-
face is in Receive Clock Master Full T1/J1 mode. If the data in only
some time slots of a T1/J1 frame is clocked out by RSCKn, the Receive
System Interface is in Receive Clock Master Fractional T1/J1 Mode.
Table 20 summarizes the receive system interface in different oper-
ating modes. To set the receive system interface of each framer into var-
ious operating modes, the registers must be configured as Table 21.
Table 20: T1/J1 Mode Receive System Interface in Different Operation Modes
Operation Mode
Data Pin
Clock Pin
Framing Pin
Signaling Pin Reference Clock Pin
Non-Multiplexed
Mode
Clock Slave Mode
RSCK Reference
RSDn
RSCCK
RSCFS/RSFSn
No
RSCKn
External Signaling
RSDn
RSCCK
RSCFS/RSFSn
RSSIGn
No
Clock Master Mode
Full T1/J1
RSDn
RSCKn
RSFSn
No
Fractional T1/J1
RSDn
RSCKn
RSFSn
No
Multiplexed Mode
MRSD
MRSCCK
MRSCFS/MRSFS
MRSSIG
No
Table 21: Operation Mode Selection in T1/J1 Receive Path
RSCCK2M / RSCCK8M (b4, T1/J1-001H) / (b3, T1/J1-001H)
IMODE[1:0] (b7~6, T1/J1-001H)
Operation Mode
00 / 10 *
10
Receive Clock Slave RSCK Reference
11
Receive Clock Slave External Signaling
00
01
Receive Clock Master Full T1/J1
00
Receive Clock Master Fractional T1/J1
01 (in any of the eight framers)
11
Receive Multiplexed
Note:
* When the RSCCK2M / RSCCK8M are '00', the system clock rate is 1.544MHz.
When the RSCCK2M / RSCCK8M are '10', the system clock rate is 2.048MHz, i.e., T1/J1 mode E1 rate.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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