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參數(shù)資料
| 型號： | IDT82V2108PXG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 79/292頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FRAMER T1/J1/E1 8CH 128-PQFP |
| 標準包裝： | 11 |
| 控制器類型： | T1/E1/J1 調(diào)幀器 |
| 接口： | 并聯(lián) |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 電流 - 電源： | 160mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-BFQFP |
| 供應商設備封裝： | 128-PQFP（14x20） |
| 包裝： | 托盤 |
| 其它名稱： | 82V2108PXG |
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Pin Description
7
March 5, 2009
RSFS[1] / MRSFS[1]
RSFS[2] / MRSFS[2]
RSFS[3]
RSFS[4]
RSFS[5]
RSFS[6]
RSFS[7]
RSFS[8]
Output
95
90
87
82
79
76
71
68
D9
D11
E11
G12
H12
J12
L12
J10
RSFS[1:8]: Receive Side System Frame Pulse for Framer 1 ~ 8
In E1 mode, RSFSn can be configured to indicate the beginning of Basic Frame, or CRC Multi-Frame or/and Signal-
ing Multi-Frame for data stream on RSDn. When configured for the Basic Frame, RSFSn will pulse high/low during
the first bit of each Basic Frame. When configured for CRC Multi-Frame, RSFSn will pulse during the first bit of the
first frame of the CRC Multi-Frame. When configured for the Signaling Multi-Frame, RSFSn will pulse during the
first bit of the first frame of the Signaling Multi-Frame. When configured to indicate both Signaling and CRC Multi-
Frame, RSFSn will go high/low on the first bit of the first frame of the Signaling Multi-Frame and go the opposite
after the first bit of the first frame of the CRC Multi-Frame.
In T1/J1 mode, RSFSn can be configured to indicate each F-bit, or the first F-bit of every 12-frame SFs / every 24-
frame ESFs. RSFSn pulses during the above F-bit.
In both E1 and T1/J1 modes, when Receive Clock Master mode is active, RSFSn is updated on the active edge of
the corresponding RSCKn. When Receive Clock Slave mode is active, RSFSn is updated on the active edge of
RSCCK.
MRSFS[1:2]: Multiplexed Receive Side System Frame Pulse
When the multiplexed bus structure is configured, the signals on these pins indicate the beginning of a multiplexed
frame. MRSFS[1:2] are updated on the active edge of MRSCCK.
RSCCK / MRSCCK
Input
120
A5
RSCCK: Receive Side System Common Clock
RSCCK is used only in Receive Clock Slave mode. In E1 mode, it is a 2.048 or 4.096 MHz clock. In T1 mode, it is a
1.544 or 2.048 or 4.096 MHz clock. In Receive Clock Slave RSCK Reference mode, RSDn and RSFSn are updated
and RSCFS is sampled on the active edge of RSCCK. In Receive Clock Slave External Signaling mode, RSDn,
RSFSn and RSSIGn are updated and RSCFS is sampled on the active edge of RSCCK.
MRSCCK: Multiplexed Receive Side System Common Clock
When the multiplexed bus structure is configured, MRSCCK is an 8.192 or 16.384 MHz clock for the receive system
multiplexed bus. MRSCFS is sampled and MRSD[1:2], MRSFS[1:2] and MRSSIG[1:2] are updated on the active
edge of MRSCCK.
RSCFS / MRSCFS
Input
119
B5
RSCFS: Receive Side System Common Frame Pulse
In Receive Clock Slave mode, RSCFS can be selected as a frame alignment reference. It is asserted on the
request of each Basic Frame or each Multi-Frame in E1 mode, or it is asserted on the request of F-bit in T1/J1
mode. RSCFS is sampled on the active edge of RSCCK.
MRSCFS: Multiplexed Receive Side System Common Frame Pulse
When the multiplexed bus structure is configured, the signal on this pin aligns the multiplexed frame to the back-
plane timing. MRSCFS is sampled on the active edge of MRSCCK.
TSD[1] / MTSD[1]
TSD[2] / MTSD[2]
TSD[3]
TSD[4]
TSD[5]
TSD[6]
TSD[7]
TSD[8]
Input
115
113
111
109
105
103
101
99
B7
D6
A8
D7
B9
A11
A12
B11
TSD[1:8]: Transmit Side System Data for Framer 1 ~ 8
The data streams from the system backplane are input on these pins.
In Transmit Clock Master mode, TSDn is sampled on the active edge of the corresponding LTCKn.
In Transmit Clock Slave mode, TSDn is sampled on the active edge of TSCCKB.
MTSD[1:2]: Multiplexed Transmit Side System Data
When the multiplexed bus structure is configured, the data stream from the backplane is carried on the multiplexed
bus for the selected framers. MTSD[1:2] are sampled on the active edge of MTSCCKB.
Name
Type
Pin No.
Description
PQFP PBGA
相關PDF資料 |
PDF描述 |
|---|---|
| VI-254-IX-S | CONVERTER MOD DC/DC 48V 75W |
| IDT82V2108PX | IC FRAMER T1/J1/E1 8CH 128-PQFP |
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相關代理商/技術參數(shù) |
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| IDT82V2608 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:INVERSE MULTIPLEXING FOR ATM |
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