Figure 20. Recommend" />
參數(shù)資料
型號(hào)： IDT82V3202NLG8
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 3/117頁(yè)
文件大?。?/td> 0K
描述： IC PLL WAN EBU SGL 68-VFQFPN
標(biāo)準(zhǔn)包裝： 2,500
類(lèi)型： 時(shí)鐘/頻率發(fā)生器，多路復(fù)用器
PLL： 是
主要目的： 以太網(wǎng)，SONET/SDH，Stratum
輸入： CMOS
輸出： CMOS，LVDS，PECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 622.08MHz
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 68-VFQFN 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 68-VFQFPN（10x10）
包裝： 帶卷 (TR)
其它名稱： 82V3202NLG8
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IDT82V3202
EBU WAN PLL
Electrical Specifications
100
September 11, 2009
8.3.2
PECL / LVDS OUTPUT PORT
8.3.2.1
PECL Output Port
Figure 20. Recommended PECL Output Port Line Ter-
mination
OUT1_POS
OUT1_NEG
V
DD (+ 3.3 V)
130
82
2 kHz
to
667 MHz
50
(transmission line)
50
(transmission line)
GND
V
DD (+ 3.3 V)
130
82
GND
Table 40: PECL Output Port Electrical Characteristics
Parameter
Description
Min
Typ
Max
Unit
Test Condition
VIL
Input Low Voltage, Differential Inputs 1
VDD - 2.5
VDD - 0.5
V
VIH
Input High Voltage, Differential Inputs 1
VDD - 2.4
VDD - 0.4
V
VID
Input Differential Voltage
0.1
1.4
V
VIL_S
Input Low Voltage, Single-ended Input 2
VDD - 2.4
VDD - 1.5
V
VIH_S
Input High Voltage, Single-ended Input 2
VDD - 1.3
VDD - 0.5
V
IIH
Input High Current, Input Differential Voltage VID = 1.4 V
-10
10
A
IIL
Input Low Current, Input Differential Voltage VID = 1.4 V
-10
10
A
VOL
Output Voltage Low 3
VDD - 2.1
VDD - 1.62
V
VOH
Output Voltage High 3
VDD - 1.25
VDD - 0.88
V
VOD
Output Differential Voltage3
580
900
mV
tRISE
Output Rise time (20% to 80%)
200
300
pS
tFALL
Output Fall time (20% to 80%)
200
300
pS
tSKEW
Output Differential Skew
50
pS
Note:
1. Assuming a differential input voltage of at least 100 mV.
2. Unused differential input terminated to VDD-1.4 V.
3. With 50
load on each pin to VDD-2 V, i.e. 82 to GND and 130 to VDD.
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