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參數(shù)資料
| 型號(hào)： | IDT82V3202NLG8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 57/117頁 |
| 文件大小： | 0K |
| 描述： | IC PLL WAN EBU SGL 68-VFQFPN |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 類型： | 時(shí)鐘/頻率發(fā)生器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum |
| 輸入： | CMOS |
| 輸出： | CMOS，LVDS，PECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 622.08MHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 68-VFQFPN（10x10） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 82V3202NLG8 |
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IDT82V3202
EBU WAN PLL
I2C Programming Interface
44
September 11, 2009
4.1.2
ADDRESS ASSIGNMENT
Figure 16. Address Assignment
Each device is recognized by a unique slave address. The slave
addressing procedure for the I2C-bus is such that the first byte after the
START condition usually determines which slave device will be selected
by the Master device. In this specification, the 4 MSB bits of the address
byte are fixed and the 3 LSB bits are decided by address input pins
AD[2:0], as shown in Figure 16.
The R/W bit is used as a data transfer direction bit which is deter-
mined by the Master device. A ‘0’ on this bit indicates a transmission
(Write) to registers and a ‘1’ indicates a request for data (Read) from the
registers.
4.2
TIMING DEFINITION
Figure 17. Timing Definition of I2C-bus
A6
A5
A4
A3
A2
A1
A0
R/W
AD2
AD1
AD0
1/0
11
00
SDA
SCL
t
LOW
t
f
t
HD: STA
t
HD: DAT
t
HIGH
t
SU: DAT
t
f
t
SU: STA
t
HD: STA
t
SP
t
SU: STO
t
BUF
S
Sr
PS
t
r
t
r
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