參數(shù)資料
型號(hào)： KIT912F634EVME
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 242/339頁(yè)
文件大?。?/td> 0K
描述： KIT EVAL FOR MM912F634
標(biāo)準(zhǔn)包裝： 1
類型： MCU
適用于相關(guān)產(chǎn)品： MM912F634
所含物品： 板，線纜，CD
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Functional Description and Application Information
Serial Peripheral Interface (S12SPIV4)
MM912F634
Freescale Semiconductor
316
4.38.3.2.1
SPI Control Register 1 (SPICR1)
Read: Anytime
Write: Anytime
Table 403. SPI Control Register 1 (SPICR1)
0x00E8
7
6
5
432
10
R
SPIE
SPE
SPTIE
MSTR
CPOL
CPHA
SSOE
LSBFE
W
Reset
0
000
10
0
Table 404. SPICR1 Field Descriptions
Field
Description
7
SPIE
SPI Interrupt Enable Bit — This bit enables SPI interrupt requests, if the SPIF or MODF status flag is set.
0 SPI interrupts disabled.
1 SPI interrupts enabled.
6
SPE
SPI System Enable Bit — This bit enables the SPI system and dedicates the SPI port pins to SPI system functions. If SPE is
cleared, SPI is disabled and forced into idle state, status bits in SPISR register are reset.
0 SPI disabled (lower power consumption).
1 SPI enabled, port pins are dedicated to SPI functions.
5
SPTIE
SPI Transmit Interrupt Enable — This bit enables SPI interrupt requests, if the SPTEF flag is set.
0 SPTEF interrupt disabled.
1 SPTEF interrupt enabled.
4
MSTR
SPI Master/Slave Mode Select Bit — This bit selects whether the SPI operates in master or slave mode. Switching the SPI
from master to slave or vice versa forces the SPI system into idle state.
0 SPI is in slave mode.
1 SPI is in master mode.
3
CPOL
SPI Clock Polarity Bit — This bit selects an inverted or non-inverted SPI clock. To transmit data between SPI modules, the
SPI modules must have identical CPOL values. In master mode, a change of this bit will abort a transmission in progress and
force the SPI system into idle state.
0 Active-high clocks selected. In idle state SCK is low.
1 Active-low clocks selected. In idle state SCK is high.
2
CPHA
SPI Clock Phase Bit — This bit is used to select the SPI clock format. In master mode, a change of this bit will abort a
transmission in progress and force the SPI system into idle state.
0 Sampling of data occurs at odd edges (1,3,5,...,15) of the SCK clock.
1 Sampling of data occurs at even edges (2,4,6,...,16) of the SCK clock.
1
SSOE
Slave Select Output Enable — The SS output feature is enabled only in master mode, if MODFEN is set, by asserting the
SSOE as shown in Table 405. In master mode, a change of this bit will abort a transmission in progress and force the SPI
system into idle state.
0
LSBFE
LSB-First Enable — This bit does not affect the position of the MSB and LSB in the data register. Reads and writes of the data
register always have the MSB in bit 7. In master mode, a change of this bit will abort a transmission in progress and force the
SPI system into idle state.
0 Data is transferred most significant bit first.
1 Data is transferred least significant bit first.
相關(guān)PDF資料
PDF描述
MRJ0800DD-A C/A MRJ21/MRJ21 GBE STRT CMR 80M
VE-JWF-EZ CONVERTER MOD DC/DC 72V 25W
EBC28DCMD-S288 CONN EDGECARD 56POS .100 EXTEND
RS-4805DZ/H3 CONV DC/DC 2W 18-72VIN +/-05VOUT
38S801C INDUCTOR 0.80UH 12.5A SMD
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參數(shù)描述
KIT912H634EVME 功能描述:開(kāi)發(fā)板和工具包 - S08 / S12 DUAL LOW&HIDE SWITCH EVB RoHS:否 產(chǎn)品:Development Kits 工具用于評(píng)估:MC9S12G128 核心:S12 接口類型:CAN, LIN, RS-232, USB 工作電源電壓:5 V 制造商:Freescale Semiconductor
KIT912J637EVME 功能描述:電源管理IC開(kāi)發(fā)工具 BATTERY SENSOR 912J637 RoHS:否 制造商:Maxim Integrated 產(chǎn)品:Evaluation Kits 類型:Battery Management 工具用于評(píng)估:MAX17710GB 輸入電壓: 輸出電壓:1.8 V
KIT912S812ECUEVM 功能描述:電源管理IC開(kāi)發(fā)工具 Single Cylinder S12XS E RoHS:否 制造商:Maxim Integrated 產(chǎn)品:Evaluation Kits 類型:Battery Management 工具用于評(píng)估:MAX17710GB 輸入電壓: 輸出電壓:1.8 V
Kit-916 制造商:ANDERSON POWER PRODUCTS 功能描述:KIT
Kit-917 制造商:ANDERSON POWER PRODUCTS 功能描述:KIT
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