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參數(shù)資料
| 型號： | KIT912F634EVME |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 62/339頁 |
| 文件大?。?/td> | 0K |
| 描述： | KIT EVAL FOR MM912F634 |
| 標準包裝： | 1 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | MM912F634 |
| 所含物品： | 板，線纜，CD |
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Functional Description and Application Information
MM912F634 - Analog Die Trimming
MM912F634
Freescale Semiconductor
154
4.25
MM912F634 - Analog Die Trimming
A trimming option is implemented to increase some device parameter accuracy. As the MM912F634 analog die is exclusively
combined with a FLASH- MCU, the required trimming values can be calculated during the final test of the device, and stored to
a fixed position in the FLASH memory. During start-up of the system, the trimming values have to be copied into the MM912F634
analog die trimming registers.
The trimming registers will maintain their content during Low Power mode, Reset will set the default value.
4.25.1
Memory Map and Register Definition
4.25.1.1
Module Memory Map
NOTE
Two word (16-Bit) transfers including CTR2 are recommended at system startup. The IFR
register has to be enabled for reading (Section 4.28.2.2.4, “MMC Control Register
To trim the bg1p25sleep there is two steps:
Step 1: First choose the right trim step by adjusting SLPBGTR[2:0] with SLPBGTRE=1,
SLPBG_LOCK bit has to stay at 0.
Step 2: Once the trim value is known, correct SLPBGTR[2:0], SLPBGTRE and
SLPBG_LOCK bits have to be set at the same time to apply and lock the trim. Once the trim
is locked, no other trim on the parameter is possible.
There are four trimming registers implemented (CTR0…CTR3), with CTR2 being reserved for future use. The following table
shows the registers used.
At system startup, the trimming information have to be copied from the MCU IFR Flash location to the corresponding MM912F634
analog die trimming registers. The following table shows the register correlation.
Table 202. MM912F634 Analog Die Trimming Registers
Offset(145)
Name
7
6
5
4
3
2
1
0
0xF0
CTR0
R
LINTRE
LINTR
WDCTRE
CTR0_4
CTR0_3
WDCTR2
WDCTR1
WDCTR0
Trimming Reg 0
W
0xF1
CTR1
R
BGTRE
CTR1_6
BGTRIMUP
BGTRIMDN
IREFTRE
IREFTR2
IREFTR1
IREFTR0
Trimming Reg 1
W
0xF2
CTR2
R
00
0
SLPBGTRE
SLPBG_LOCK
SLPBGTR2
SLPBGTR1
SLPBGTR0
Trimming Reg 2
W
0xF3
CTR3
R
OFFCTRE
OFFCTR2
OFFCTR1
OFFCTR0
CTR3_E
CTR3_2
CTR3_1
CTR3_0
Trimming Reg 3
W
Note:
145. Offset related to 0x0200 for blocking access and 0x300 for non blocking access within the global address space.
Table 203. MM912F634 - MCU vs. Analog Die Trimming Register Correlation
Name
MCU IFR Address
Analog Offset(146)
CTR0
0x4C
0xF0
CTR1
0x4D
0xF1
CTR2
0x4E
0xF2
CTR3
0x4F
0xF3
Note:
146. Offset related to 0x0200 for blocking access and 0x300 for non blocking access within the global address space.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MRJ0800DD-A | C/A MRJ21/MRJ21 GBE STRT CMR 80M |
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| EBC28DCMD-S288 | CONN EDGECARD 56POS .100 EXTEND |
| RS-4805DZ/H3 | CONV DC/DC 2W 18-72VIN +/-05VOUT |
| 38S801C | INDUCTOR 0.80UH 12.5A SMD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| Kit-916 | 制造商:ANDERSON POWER PRODUCTS 功能描述:KIT |
| Kit-917 | 制造商:ANDERSON POWER PRODUCTS 功能描述:KIT |
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