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參數(shù)資料
| 型號： | LH77790B |
| 廠商： | Sharp Corporation |
| 英文描述： | Embedded Microcontroller(32位嵌入式微控制器) |
| 中文描述： | 嵌入式微控制器（32位嵌入式微控制器） |
| 文件頁數(shù)： | 113/236頁 |
| 文件大?。?/td> | 865K |
| 代理商： | LH77790B |
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Pulse Width Modulator (PWM)
LH77790B User
’
s Guide
9-12
Output Invert Registers [PWMn_INV (n
= 0, 1, 2)]
PWMn_INV is double buffered to allow it to be programmed statically (PWMn is stopped)
or dynamically (PWMn is running). Programmed dynamically, PWMn_INV is updated at
the end of a PWMn cycle thus causing no output glitches or errors.
A read/write access to PWMn_INV will read/write its buffer. The buffered data will be writ-
ten to PWMn_INV as shown in Table 9-10.
This will allow the system designer to program the PWMn output to fit any application. The
following diagram provides an example of two identical but inverted output pulses.
A write to PWMA_INV allows writing a common value to PWM0_INV, PWM1_INV, and
PWM2_INV at the same time.
7
1
0
///
INV
Table 9-9. PWMn_INV Fields
BIT
POSITION
NAME
DESCRIPTION
0
INV
Invert PWMn Output:
0: Output is not inverted. PWMn_OUT will output t
OFF
first then t
ON
.
PWMn_DC controls t
ON
.
1: Output is inverted. PWMn_OUT will output t
ON
first then t
OFF
.
PWMn_DC controls t
OFF
.
Reserved
7:1
///
Table 9-10. PWMn_INV Update
PWMn State
Stopped
Running
PWMn
_INV
Updated
A write to PWMn_ENB
At the End of a PWMn_Cycle
Figure 9-5. PWMn_INV Example
1
2
3
5
7
4
6
PULSE 1
PULSE 2
t
ON
t
OFF
PWM0_INV = 0
DUTY CYCLE = t
ON
/(t
ON
+ t
OFF
)
t
OFF
t
ON
PWM1_INV = 1
DUTY CYCLE = t
OFF
/(t
ON
+ t
OFF
)
PWM1_OUT
PULSE
PWM0_OUT
PULSE
SYSTEM
CLOCK
ARM2-85
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PDF描述 |
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| LH79520N0M000B1,551 | 制造商:NXP Semiconductors 功能描述: |
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