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參數(shù)資料
| 型號： | M30240S9-XXXFP |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | 16 Characters x 2 Lines, 5x7 Dot Matrix Character and Cursor |
| 中文描述： | 單片16位CMOS微機(jī) |
| 文件頁數(shù)： | 42/142頁 |
| 文件大?。?/td> | 1637K |
| 代理商： | M30240S9-XXXFP |
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1-42
Mitsubishi microcomputers
M30240 Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
Preliminary Specifications REV. E
Specifications in this manual are tentative and subject to change
Frequency Synthesizer Circuit
2.17.2 Multiplier
Clock f
VCO
is a multiplied up version of clock f
PIN
(See Figure 1.25). The relationship between f
VCO
and the clock input to the multiplier (f
PIN
) from the prescaler is as follows:
f
VCO
= f
PIN
x 2(n+1) where nis the decimal equivalent of the value loaded in FSM.
Setting FSM to 255 disables the multiplier and f
VCO
= f
PIN
.
Note 1: nmust be chosen such that f
VCO
equals 48 MHz.
Note 2: Minimum f
PIN
is 1 MHz.
Figure 1.25: Frequency Synthesizer Multiply Register (FSM)
2.17.3 Divider
Clock f
SYN
is a divided down version of clock f
VCO
(See Figure 1.26). The relationship between f
SYN
and the clock input to the divider (f
VCO
) from the multiplier is as follows:
f
SYN
= f
VCO
/ 2(m+1) where m is the decimal equivalent of the value loaded in FSD.
Setting FSD to 255 disables the divider and f
SYN
= f
VCO
.
Figure 1.26: Frequency Synthesizer Divide Register (FSD)
f
PIN
x 2(
n
+1) = f
VCO
f
PIN
FSM
Dec(n)
33
11
5
3
1
f
VCO
Hex(n)
4A
0B
05
03
01
1 MHz
2 MHz
4 MHz
6 MHz
12 MHz
48.00 MHz
48.00 MHz
48.00 MHz
48.00 MHz
48.00 MHz
MSB
7
LSB
0
Bit 6
Bit 1
Bit 0
Bit 2
Bit 5
Bit 4
Bit 3
Bit 7
Address: 03DD
16
Access: R/W
Reset: FF
16
f
VCO
/2(m+1) = f
SYN
f
VCO
FSD
Dec(m)
1
127
f
SYN
Hex(m)
01
7F
48.00 MHz
48.00 MHz
12.00 MHz
187.50 KHz
MSB
7
LSB
0
Bit 6
Bit 1
Bit 0
Address: 03DF
16
Access: R/W
Reset: FF
16
Bit 2
Bit 5
Bit 4
Bit 3
Bit 7
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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