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參數(shù)資料
| 型號： | MB90F562 |
| 廠商： | Fujitsu Limited |
| 英文描述： | Octal Bus Transceivers And Registers With 3-State Outputs 24-CDIP -55 to 125 |
| 中文描述： | 16位微控制器 |
| 文件頁數(shù)： | 319/581頁 |
| 文件大?。?/td> | 3144K |
| 代理商： | MB90F562 |
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MB90560 series
CHAPTER 12 MULTI-FUNCTION TIMER
295
Table 12.3.1.3-1 Timer Control Status Register (Upper) Bit
Bit
Function
Bit 15
ECKE:
Clock Selection
bit
This bit is used to select either external or internal count clock
source for the 16-bit free-run timer. Change this bit when the
output compare and input capture are in stop status because
the clock will be changed as soon as this bit is changed.
Note:
When selecting internal clock, set the count clock to bit
2~0 (CLK2~0). This count clock will become the base
clock. When inputting clock from FRCK pin, set
DDR1:bit7=”0”
Bit 14
Bit 13
Unused bit
The read value is indeterminate.
Writing to this bit has no effect on the operation.
Bit 12
Bit 11
Bit 10
MIS2~0:
Masking
interrupt bit
These bits are used to set the number of times of masking the
compare clear interrupt. 16-bit free-run timer will reload the
count value every time when these 3 bits is not “000
B
” and the 3
bits will be decrement by 1 until these 3 bits becomes “000
B
”.
The number of masking interrupt = the value of these 3 bits.
(i.e. When masking two times and interrupt is generated in the
3rd time of the match, set the value = “010
B
”. However, there is
no masking interrupt when the value is “000
B
”.
Bit 9
ICLR:
Compare
Interrupt
request flag bit
This bit is an interrupt request flag for compare clear.
When the compare clear register and 16-bit free-run timer value
are matched and the counter is cleared, this bit will become “1”.
Interrupt is generated when the interrupt request enable bit
(Bit8: ICRE) is set to “1”.
Writing “0” will clear this bit.
Writing “1” has no effect.
In Read-Modify-Write operation, “1” is always read.
Bit 8
ICRE:
Compare
Interrupt
request enable
bit
This is the interrupt request enable bit for the compare clear.
When this bit is “1” and the interrupt flag (Bit9: ICLR) is set to
“1”, an interrupt will be generated.
相關PDF資料 |
PDF描述 |
|---|---|
| MB90V560 | 16-BIT MICROCONTROLLER |
| MB90560 | Hex Schmitt-trigger Inverters 20-LCCC -55 to 125 |
| MB90F568PF | 16-bit Proprietary Microcontrollers |
| MB90F568PFM | 16-bit Proprietary Microcontrollers |
| MB90F562BPFM | 16-bit Proprietary Microcontrollers |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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