- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄359133 > MC33989 (飛思卡爾半導(dǎo)體(中國)有限公司) System Basis Chip with High Speed CAN Transceiver(帶高速CAN收發(fā)器的系統(tǒng)基片) PDF資料下載
參數(shù)資料
| 型號： | MC33989 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 元件分類： | CAN |
| 英文描述： | System Basis Chip with High Speed CAN Transceiver(帶高速CAN收發(fā)器的系統(tǒng)基片) |
| 中文描述： | 系統(tǒng)基礎(chǔ)芯片的高速CAN收發(fā)器（帶高速的CAN收發(fā)器的系統(tǒng)基片） |
| 文件頁數(shù)： | 29/32頁 |
| 文件大小： | 676K |
| 代理商： | MC33989 |
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MC33989
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MC33989
If HS1OT-V2LOW interrupt is only selected (only bit D2 set in INTR register), reading INTR register bit D2 leads to two
possibilities:
Bit D2 = 1: INT source is HS1OT.
Bit D2 = 0: INT source is V2LOW.
HS1OT and V2LOW bits status are available in IOR register.
Upon a wake up condition from stop mode due to over current detection (Idd1s-wu1 or Idd1s-wu2), an INT pulse is generated,
however INTR register content remains at 0000 (not bit set into the INTR register).
The status bit of the INT register content are a copy of the IOR and CAN registers status content. To clear the INT register bit
the IOR and/or CAN register must be cleared (read register). Once this operation is done at IOR and CAN register the INT register
is updated.
Errors bits are latched in the CAN and IOR registers.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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