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參數(shù)資料
| 型號： | MC68EC040 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessors.(32位微處理器) |
| 中文描述： | 32位微處理器。（32位微處理器） |
| 文件頁數(shù)： | 190/442頁 |
| 文件大?。?/td> | 2582K |
| 代理商： | MC68EC040 |
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7-48
M68040 USER’S MANUAL
MOTOROLA
Table 7-6. M68040 Bus Arbitration States
BB
BG
State
Conditions
Negated
Negated
Idle
M68040 three-states
BB
; arbiter negates
BG
; bus is not driven.
Negated
Asserted
Implicit Ownership
M68040 three-states
BB
; arbiter asserts
BG
; bus is driven with undefined values.
Asserted
Negated
Active Bus Cycle
M68040 asserts
BB
; arbiter asserts
BG
;
bus is driven with defined values;
TIP
is asserted.
Asserted
Asserted
Park
M68040 asserts
BB
; arbiter asserts
BG
;
bus is driven with undefined values;
TIP
is
asserted.
Asserted
Asserted
Alternate Bus Master Ownership
and Snooped
M68040 three-states
BB
; arbiter asserts
BG
; M68040 does not drive the bus.
The M68040 can be in the active bus cycle, park, or implicit ownership states when
BG
is
negated. Depending on the state the processor is in when
BG
is negated, uncertain
conditions can occur. The only guaranteed time that the processor relinquishes the bus is
when
BG
is negated prior to the rising edge of BCLK in which the last
TA
or
TEA
is
asserted and the processor is in the active bus cycle state. However, if the processor is in
either the active bus cycle, park, or implicit ownership states and
BG
is negated at the
same time or after the last
TA
or
TEA
is asserted, then from the standpoint of the external
bus arbiter, the next action that the processor takes is undetermined because the
processor can internally decide to perform another active bus cycle (indeterminate
condition).
External bus arbiters must consider this indeterminate condition when negating
BG
and
must be designed to examine the state of
BB
immediately after negating
BG
to determine
whether or not the processor will run another bus cycle. A somewhat dangerous situation
exists when the processor begins a locked transfer after the bus has been granted to the
alternate bus master, causing the alternate bus master to perform a bus transfer during a
locked sequence. To correct this situation, the external bus arbiter must be able to
recognize the possible indeterminate condition and reassert
BG
to the processor when the
processor begins a locked sequence. The indeterminate condition is most significant when
dealing with systems that cannot allow locked transfers to be broken. Figure 7-31
illustrates an example of an error condition that is a consequence of the interaction
between the indeterminate condition and a locked transfer. External bus arbiters must be
designed so that all bus grants to all bus masters be nagated for at least one rising edge
of BCLK between bus tenures; preventing bus conflicts resulting from the above
conditions.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68EC040V | 32-Bit Microprocessors.(32位微處理器) |
| MC68LC040 | 32-Bit Microprocessors.(32位微處理器) |
| MC68160BFB | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
| MC68160 | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
| MC68160B | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68EC040BRC33A | 制造商:Motorola Inc 功能描述: |
| MC68EC040E25A | 制造商:Freescale Semiconductor 功能描述: |
| MC68EC040FE20A | 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68EC040FE20B | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:M68000-compatible, high-performance, 32-bit microprocessors |
| MC68EC040FE25 | 制造商:Motorola Inc 功能描述: |
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