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參數(shù)資料
| 型號： | MC68EC040 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessors.(32位微處理器) |
| 中文描述： | 32位微處理器。（32位微處理器） |
| 文件頁數(shù)： | 361/442頁 |
| 文件大小： | 2582K |
| 代理商： | MC68EC040 |
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MOTOROLA
M68040 USER’S MANUAL
A-1
REV2.3 (01/29/2000)
APPENDIX A
MC68LC040
NOTE
Rev. 2.3 contains timing informationg for 40 MHz operation.
Refer to chang bars for these additions.
All references to MC68LC040 also apply to the MC68040V.
Refer to
Appendix C MC68040V and MC68EC040V
information on the MC68040V.
for more
The MC68LC040 is Motorola's integer-only version of the MC68040 third-generation,
M68000-compatible, high-performance, 32-bit microprocessor. The MC68LC040 is a virtual
memory microprocessor with a highly integrated architecture that provides very high perfor-
mance in a monolithic HCMOS device. On a single chip, the MC68LC040 integrates an
MC68040-compatible integer unit and fully independent instruction and data demand-paged
memory management units (MMUs), including independent 4-Kbyte instruction and data
caches. A high degree of instruction execution parallelism is achieved through the use of a
six-stage instruction pipeline, multiple internal buses, and a full internal Harvard architec-
ture, including separate physical caches for both instruction and data accesses. The
MC68LC040 also directly supports cache coherency in multimaster applications with dedi-
cated on-chip bus snooping logic.
The MC68LC040 achieves its high performance through the use of the MC68040 integer
unit. The six-stage pipeline operates on up to six instructions concurrent with MMU, cache,
and bus controller operations. Multiple internal buses, separate data and instruction caches,
and a sophisticated bus controller allow internal units to operate concurrently and decouple
the MC68LC040 from the external bus. The internal caches and the decoupling of the exter-
nal bus allow for an external memory subsystem to be built from slower and less expensive
memories with minimal impact to the overall system performance. The potential for a
low-cost system design with the price/performance of the MC68LC040 makes it a good
choice for embedded microprocessor applications as well as central processor applications.
The MC68LC040 is user-object-code compatible with previous members of the M68000
family and is specifically optimized to reduce the execution time of compiler-generated code.
The high level of performance is ideal for integer-intensive applications. The MC68LC040 is
implemented in Motorola's latest HCMOS technology, providing an ideal balance between
speed, power, and physical device size. Independent data and instruction MMUs control the
main caches and the address translation caches (ATCs). The ATCs speed up logi-
cal-to-physical address translations by storing recently used translations. The bus snooper
circuit ensures cache coherency in multimaster and multiprocessing applications. The
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68EC040V | 32-Bit Microprocessors.(32位微處理器) |
| MC68LC040 | 32-Bit Microprocessors.(32位微處理器) |
| MC68160BFB | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
| MC68160 | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
| MC68160B | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68EC040BRC33A | 制造商:Motorola Inc 功能描述: |
| MC68EC040E25A | 制造商:Freescale Semiconductor 功能描述: |
| MC68EC040FE20A | 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68EC040FE20B | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:M68000-compatible, high-performance, 32-bit microprocessors |
| MC68EC040FE25 | 制造商:Motorola Inc 功能描述: |
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