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參數(shù)資料
| 型號： | MC68EC040 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessors.(32位微處理器) |
| 中文描述： | 32位微處理器。（32位微處理器） |
| 文件頁數(shù)： | 195/442頁 |
| 文件大小： | 2582K |
| 代理商： | MC68EC040 |
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MOTOROLA
M68040 USER’S MANUAL
7-53
how the
LOCKE
signal can be used to end a locked sequence and to yield the bus one
bus cycle earlier than is normally possible. Figure 7-35 illustrates the state diagram of a
hypothetical external arbiter design.
BB
Λ
LOCK
Λ
LOCKE*
STATE A
STATE B
STATE C
STATE D
BR1*
V
BR1
Λ
LOCK
Λ
LOCKE*
BB
Λ
LOCK*
V
BB
Λ
LOCK
Λ
LOCKE
BG1* BG2
BG1, BG2*
BR2
Λ
LOCK
Λ
LOCKE
V
BR2
Λ
LOCK*
BR2*
V
BR2
Λ
LOCK
Λ
LOCKE
BB*
BG1* BG2
BG1, BG2*
BB
Λ
LOCK*
V
BB
Λ
LOCK
Λ
LOCKE
BB*
BR1
Λ
LOCK
Λ
LOCKE
V
BR1
Λ
LOCK*
Because this example uses two MC68040s, 1 and 2 refer to the processor and its signals.
*Indicates the signal is asserted for that device.
NOTES:
1.
2.
BB
Λ
LOCK
Λ
LOCKE*
Figure 7-35. Dual M68040 Fairness Arbitration State Diagram
Assuming that processor 1 currently owns the bus, the external arbiter is in state A. If
processor 2 asserts
BR2
, then processor 1 behaves in one of three ways:
1. If processor 1 is currently in the middle of a nonlocked bus access, then the external
arbiter proceeds to state B, in which
BG1
is negated and
BG2
is asserted. The
external arbiter then proceeds to state C only when
BB
is negated, signifying the end
of the bus cycle.
2. If processor 1 is currently in the middle of a locked bus access, then the external
arbiter stays in state A until
LOCKE
is asserted. Once
LOCKE
is asserted, the
external arbiter enters state B, in which
BG1
is negated and
BG2
is asserted. The
external arbiter proceeds to state C once
BB
is negated, signifying the end of the
bus cycle.
3. If processor 1 is in one of the three boundary conditions, then the external arbiter
proceeds to state B. During state B, the external arbiter checks for the possibility of a
newly initiated locked bus access. If it detects a locked bus cycle, it returns the bus
to processor 1 by entering state A. Note that even though processor 1 recognizes
BG1
is asserted, it does not take the bus because processor 1 asserts
BB
whenever
the boundary condition results in processor 1 performing another bus cycle. The
external arbiter stays in state A until
LOCKE
is asserted, then proceeds to state B to
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68EC040V | 32-Bit Microprocessors.(32位微處理器) |
| MC68LC040 | 32-Bit Microprocessors.(32位微處理器) |
| MC68160BFB | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
| MC68160 | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
| MC68160B | ENHANCED ETHERNET INTERFACE TRANSCEIVER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68EC040BRC33A | 制造商:Motorola Inc 功能描述: |
| MC68EC040E25A | 制造商:Freescale Semiconductor 功能描述: |
| MC68EC040FE20A | 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68EC040FE20B | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:M68000-compatible, high-performance, 32-bit microprocessors |
| MC68EC040FE25 | 制造商:Motorola Inc 功能描述: |
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