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參數(shù)資料
| 型號： | MT18VDVF6472DG-265XX |
| 元件分類： | DRAM |
| 英文描述： | 64M X 72 DDR DRAM MODULE, 0.75 ns, DMA184 |
| 封裝： | DIMM-184 |
| 文件頁數(shù)： | 19/38頁 |
| 文件大?。?/td> | 713K |
| 代理商： | MT18VDVF6472DG-265XX |
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PDF: 09005aef81c73825/Source: 09005aef81c73837
Micron Technology, Inc., reserves the right to change products or specifications without notice.
DVF18C64_128x72D_2.fm - Rev. A 8/05 EN
26
2003, 2004, 2005 Micron Technology, Inc. All rights reserved.
512MB, 1GB: (x72, DR) 184-Pin DDR VLP RDIMM
Notes
44. IDD2N specifies the DQ, DQS, and DM to be driven to a valid high or low logic level.
IDD2Q is similar to IDD2F except IDD2Q specifies the address and control inputs to
remain stable. Although IDD2F, IDD2N, and IDD2Q are similar, IDD2F is “worst case.”
45. Whenever the operating frequency is altered, not including jitter, the DLL is required
to be reset. This is followed by 200 clock cycles (before READ commands).
46. Leakage number reflects the worst case leakage possible through the module pin, not
what each memory device contributes.
47. When an input signal is HIGH or LOW, it is defined as a steady state logic HIGH or
LOW.
48. The -335 speed grade will operate with tRAS (MIN) = 40ns and tRAS (MAX) = 120,000ns
at any slower frequency.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MT46H256M32L2JV-75IT:A | 256M X 32 DDR DRAM, 6 ns, PBGA168 |
| MT46H256M32L4CM-54IT:A | 256M X 32 DDR DRAM, 5 ns, PBGA90 |
| MT46H256M32L4MC-54AT:A | 256M X 32 DDR DRAM, 5 ns, PBGA240 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MT190A | 制造商:Black Box Corporation 功能描述:SMART 64K CSU/DSU |
| MT190AD130 | 制造商:BLACK BOX 功能描述:64K CSU/DSU |
| MT190A-D48 | 制造商:Black Box Corporation 功能描述:Smart 64K CSU/DSUs, 24 48-VDC |
| MT190A-D48-W1 | 制造商:Black Box Corporation 功能描述:1 YEAR WARRANTY FOR MT190A-D48 |
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