參數(shù)資料
型號： MT80C31-25R
廠商： TEMIC SEMICONDUCTORS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, 25 MHz, MICROCONTROLLER, PQFP44
文件頁數(shù)： 1216/1447頁
文件大?。?/td> 3788K
代理商： MT80C31-25R
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790
6437E–ATARM–23-Apr-13
SAM9M11
q.
Program LLI_B(n).DMAC_DSCR with address of descriptor LLI_W(n+1). If
LLI_B(n) is the last descriptor, then program LLI_B(n).DMAC_DSCR with 0.
r.
Program DMAC_CTRLBx register for channel x with 0, its content is updated with
the LLI Fetch operation.
s.
Program DMAC_DSCRx with the address of LLI_W(0) if block_length is greater
than 4 else with address of LLI_B(0).
t.
Enable Channel x writing one to DMAC_CHER[x]. The DMAC is ready and waiting
for request.
4.
Enable DMADONE interrupt in the HSMCI_IER register.
5.
Poll CBTC[x] bit in the DMAC_EBCISR Register.
6.
If a new list of buffers shall be transferred, repeat step 7. Check and handle HSMCI
errors.
7.
Poll FIFOEMPTY field in the HSMCI_SR.
8.
Send The STOP_TRANSMISSION command writing HSMCI_ARG then
HSMCI_CMDR.
9.
Wait for XFRDONE in HSMCI_SR register.
37.8.8.3
Block Length is Not a Multiple of 4. (ROPT field in HSMCI_DMA register set to 1)
One DMA Transfer descriptor is used to perform the HSMCI block transfer, the DMA writes a
rounded up value to the nearest multiple of 4.
1.
Use the previous step to configure the HSMCI to perform a READ_MULTIPLE_BLOCK.
2.
Set the ROPT field to 1 in the HSMCI_DMA register.
3.
Issue a READ_MULTIPLE_BLOCK command.
4.
Program the DMA controller to use a list of descriptors:
a.
Read the channel Register to choose an available (disabled) channel.
b.
Clear any pending interrupts on the channel from the previous DMAC transfer by
reading the DMAC_EBCISR register.
c.
Program the channel registers in the Memory with the first descriptor. This descrip-
tor will be word oriented. This descriptor is referred to as LLI_W(n), standing for LLI
word oriented transfer for block n.
d.
The LLI_W(n).DMAC_SADDRx field in memory must be set with the starting
address of the HSMCI_FIFO address.
e.
The LLI_W(n).DMAC_DADDRx field in the memory must be word aligned.
f.
Program LLI_W(n).DMAC_CTRLAx with the following field’s values:
–DST_WIDTH is set to WORD.
–SRC_WIDTH is set to WORD.
–SCSIZE must be set according to the value of HSMCI_DMA, CHKSIZE field.
–BTSIZE is programmed with Ceiling(block_length/4).
g.
Program LLI_W(n).DMAC_CTRLBx with the following field’s values:
–DST_INCR is set to INCR
–SRC_INCR is set to INCR
–FC field is programmed with peripheral to memory flow control mode.
–SRC_DSCR is set to 0. (descriptor fetch is enabled for the SRC)
–DST_DSCR is set to TRUE. (descriptor fetch is disabled for the DST)
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PDF描述
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