參數(shù)資料
型號(hào)： RIVA128
廠商： 意法半導(dǎo)體
英文描述： RIVA 128⑩ 128-BIT 3D MULTIMEDIA ACCELERATOR
中文描述： 麗娃128⑩128位3D多媒體加速器
文件頁(yè)數(shù)： 24/85頁(yè)
文件大?。?/td> 609K
代理商： RIVA128
128-BIT 3D MULTIMEDIA ACCELERATOR
RIVA128ZX
24/85
5.2
The timing specification of the PCI interface takes the form of generic setup, hold and delay times of tran-
sitions to and from the rising edge of
PCICLK
as shown in Figure 17.
Figure 17.
PCI timing parameters
PCI TIMING SPECIFICATION
Table 6.
PCI timing parameters
NOTE
1
PCIREQ#
and
PCIGNT#
are point to point signals and have different valid delay and input setup times than bussed sig-
nals. All other signals are bussed.
Symbol
Parameter
Min.
Max.
Unit
Notes
t
VAL
PCICLK
to signal valid delay (bussed signals)
2
11
ns
1
t
VAL
(PTP)
PCICLK
to signal valid delay (point to point)
2
12
ns
1
t
ON
Float to active delay
2
ns
t
OFF
Active to float delay
28
ns
t
SU
Input set up time to
PCICLK
(bussed signals)
7
ns
1
t
SU
(PTP)
Input set up time to
PCICLK
(
PCIGNT#
)
10
ns
1
t
SU
(PTP)
Input set up time to
PCICLK
(
PCIREQ#
)
12
ns
t
H
Input hold time from
PCICLK
0
ns
t
VAL
t
ON
t
OFF
t
SU
t
H
PCICLK
Output delay
Tri-state output
Input
PCICLK
Output timing parameters
Input timing parameters
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