參數(shù)資料
型號(hào)： RIVA128ZX
廠商： 意法半導(dǎo)體
英文描述： 128-BIT 3D MULTIMEDIA ACCELERATOR
中文描述： 128位3D多媒體加速器
文件頁數(shù)： 21/85頁
文件大?。?/td> 609K
代理商： RIVA128ZX
128-BIT 3D MULTIMEDIA ACCELERATOR
RIVA128ZX
21/85
AGP timing specification
Figure 12.
AGP clock specification
Table 1.
AGP clock timing parameters
NOTES
1
This rise and fall time is measured across the minimum peak-to-peak range as shown in Figure 12.
Figure 13.
AGP timing diagram
Table 2.
AGP timing parameters
Symbol
Parameter
Min.
Max.
Unit
Notes
t
CYC
PCICLK
period
15
30
ns
t
HIGH
PCICLK
high time
6
ns
t
LOW
PCICLK
low time
6
ns
PCICLK
slew rate
1.5
4
V/ns
1
Symbol
Parameter
Min.
Max.
Unit
Notes
t
VAL
AGPCLK
to signal valid delay (data and control
signals)
2
11
ns
t
ON
Float to active delay
2
ns
t
OFF
Active to float delay
28
ns
t
SU
Input set up time to
AGPCLK
(data and control
signals)
7
ns
t
H
Input hold time from
AGPCLK
0
ns
t
CYC
t
HIGH
t
LOW
PCICLK
0.3VDD
0.4VDD
0.5VDD
0.2VDD
0.6VDD
2V p-to-p
(minimum)
t
VAL
t
VAL
t
ON
t
OFF
t
SU
t
H
data1
data2
data1
data2
AGPCLK
Output delay
Tri-state output
Input
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PDF描述
RIVA128 RIVA 128⑩ 128-BIT 3D MULTIMEDIA ACCELERATOR
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