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參數(shù)資料
| 型號： | SAA4979H |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | Sample rate converter with embedded high quality dynamic noise reduction and expansion port |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP128 |
| 封裝： | 28 X 28 X 3.40 MM, PLASTIC, QFP-128 |
| 文件頁數(shù)： | 5/52頁 |
| 文件大?。?/td> | 224K |
| 代理商： | SAA4979H |
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2002 May 28
5
Philips Semiconductors
Product specification
Sample rate converter with embedded high quality
dynamic noise reduction and expansion port
SAA4979H
6
PINNING
SYMBOL
PIN
TYPE
DESCRIPTION
V
DDO1
RSTR2
RE2
OIE2
V
SSO1
RSTW2
DI10
DI11
DI12
DI13
DI14
DI15
DI16
DI17
V
SSD1
LLC1
V
DDD1
V
DDP
DI20
DI21
DI22
DI23
DI24
DI25
DI26
DI27
V
SSD2
LLC2
V
DDD2
TCK
TDI
TMS
TRST
n.c.
TDO
V
DDA1
YOUT
V
SSA1
UOUT
V
DDA2
1
2
3
4
5
6
7
8
9
supply
digital output (test input)
digital output (test input)
digital output (test input)
ground
digital input
digital input
digital input
digital input
digital input
digital input
digital input
digital input
digital input
ground
digital input
supply
supply
digital input
digital input
digital input
digital input
digital input
digital input
digital input
digital input
ground
digital input
supply
digital input
digital input
digital input
digital input
digital output
supply
analog output
ground
analog output
supply
I/O supply voltage 1 (3.3 V)
reset read, source 2
read enable, source 2
output/input enable, source 2
I/O ground 1
reset write, source 2
ITU 656 input bit 0 (LSB), source 1
ITU 656 input bit 1, source 1
ITU 656 input bit 2, source 1
ITU 656 input bit 3, source 1
ITU 656 input bit 4, source 1
ITU 656 input bit 5, source 1
ITU 656 input bit 6, source 1
ITU 656 input bit 7 (MSB), source 1
digital ground 1
27 MHz clock signal, source 1
digital supply voltage 1 (3.3 V)
protection supply voltage (5 V)
ITU 656 input bit 0 (LSB), source 2
ITU 656 input bit 1, source 2
ITU 656 input bit 2, source 2
ITU 656 input bit 3, source 2
ITU 656 input bit 4, source 2
ITU 656 input bit 5, source 2
ITU 656 input bit 6, source 2
ITU 656 input bit 7 (MSB), source 2
digital ground 2
27 MHz clock signal, source 2
digital supply voltage 2 (3.3 V)
test clock
test data input
test mode select
test reset (active LOW)
not connected
test data output
analog supply voltage 1 (3.3 V)
Yanalog output
analog ground 1
(B
Y) analog output
analog supply voltage 2 (3.3 V)
10
11
12
13
14
15
16
17
18
19
20
21
22
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24
25
26
27
28
29
30
31
32
33
34 to 41
42
43
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45
46
47
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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