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參數(shù)資料
| 型號： | SPAK56853FG120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數(shù)： | 165/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56853FG120 |
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Operating Modes
MOTOROLA
Serial Peripheral Interface (SPI)
11-7
Preliminary
11
11.6 Operating Modes
The SPI has two operating modes:
Master
Slave
An operating mode is selected by the SPMSTR bit in the SPSCR as follows:
SPMSTR = 0 Slave mode
SPMSTR = 1 Master mode
Note:
The SPMSTR bit should be configured before enabling the SPI, setting the SPE
bit in the SPSCR. The master SPI should be enabled before enabling any slave
SPI. All slave SPIs should be disabled before disabling the master SPI.
11.6.1 Master Mode
The SPI operates in master mode when the SPI master bit, SPMSTR, is set.
Note:
Configure the SPI module as master or slave before enabling the SPI. Enable
the master SPI before enabling the slave SPI. Disable the slave SPI before
disabling the master SPI.
Only a Master SPI module can initiate transmissions. With the SPI enabled, software
begins the transmission from the master SPI module by writing to the SPI Data Transmit
Register (SPDTR). If the Shift Register is empty, the data immediately transfers to the
Shift Register, setting the SPI Transmitter Empty (SPTE) bit. The data begins shifting out
on the MOSI pin under the control of the SPI Serial Clock (SCLK).
The SPR2, SPR1 and SPR0 bits in the SPSCR register, control the baud rate generator and
determine the speed of the shift register. Through the SCLK pin, the baud rate generator of
the master also controls the shift register of the slave peripheral.
As the data shifts out on the MOSI pin of the master, external data shifts in from the slave
on the master’s MISO pin. The transmission ends when the receiver full bit, SPRF,
becomes set. At the same time the SPRF becomes set, the data from the slave transfer to the
receive data register. In normal operation, SPRF signals the end of a transmission. Software
clears SPRF by reading the SPI data receive register, SPDRR. Writing to the SPI data
transmit register, SPDTR, clears the SPTE bit.
Figure 11-3 is an example configuration for a Full-Duplex Master-Slave Configuration.
Having the SS bit of the Master DSP held high is only necessary if MODFEN = 1. Tying
the Slave DSP SS bit to ground should only be executed if CPHA = 1.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPAK56855BU120 | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
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| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
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參數(shù)描述 |
|---|---|
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| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
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| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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